BitRecords FPGA Modul XC6SLX25_V2.0, Mai2013 1
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- Werner Hofmeister
- vor 8 Jahren
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1 BitRecords FPGA Modul XCSLX FPGA Modul zur Anwendung im Hobby- und Prototypenbereich Eigenschaften: Xilinx Spartan (XCSLX-FGGC) Nutzer-IOs On-Board 0MHz Oszillator LEDs, Taster Rastermaß:. mm Maße: x mm SPI Flash zur Speicherung von Konfigurationen und Nutzerdaten -Pin JTAG Header Spannungsversorgung.V IO-Spannungen der FPGA-Bänke individuell einstellbar Versorgungspannungen: Zum Betrieb des Moduls ist eine Spannung von.v notwendig. Diese ist an einem der Versorgungspins über die Pinleiste bereitzustellen (siehe Pinbelegungen). Bei korrektem Betrieb leuchtet LED. Die Betriebsspannungen der drei FPGA-Bänke können über die Pinleiste in Abhängigkeit ihrer Anwendung individuell bereitgestellt werden. Folgende Pins sind dafür vorgesehen: SV, Pin = Bank SV, Pin = Bank SV, Pin = Bank Sämtliche Pins der jeweiligen Leiste sind mit FPGA-IOs der entspechende Bänke verbunden. Für eine gewünschte IO-Spannung von.v kann der Versorgungspin der FPGA-Bank in einfachsten Fall mit dem direkt benachbarten Versorgungspin des Moduls verbunden werden. Alle anderen Spannungen müssen separat bereit gestellt werden. On-Board Schnittstellen: Das Modul ist bestückt mit Nutzer-LEDs (active high) und einem Taster (active low). Zur synchronen Ablaufsteuerung wurde ein 0MHz Oszillator integriert. Folgende FPGA Pins wurden hierfür verwendet: Flash Speicher: LED B LED C Taster A 0MHz Y Der angebundene MBit SPI Flash Speicher (Nymonyx MP) kann neben der Ablage von BitRecords FPGA Modul XCSLX_V.0, Mai0
2 Programmdateien auch zur Speicherung von Nutzerdaten verwendet werden. Folgende FPGA-Pins wurden hierfür verwendet: D (Serial Data Input) AB0 (FPGA-Pin) Q (Serial Data Output) AA0 C (Serial Clock) Y S (Chip Select) T Die Flash-Signale W und HOLD sind permanent auf HIGH gelegt. Konfiguration: Die Parametrierung des Moduls erfolgt über einen -Pin JTAG-Header, mit dem Konfigurationsdaten zu Testzwecken direkt in das FPGA oder zum automatischen Laden nach Systemstart in den angebundenen SPI Flash übertragen werden können. Die Konfiguration kann z.b. mittels des Xilinx impact Tools erfolgen. Eine erfolgreiche Konfiguration wird durch die leuchtende DONE LED angezeigt. Das Speichern der Konfigurationsdaten im Flash erfolgt durch indirekte SPI Programmierung. Eine detaillierte Anleitung befindet sich im Anhang B. Pinbelegungen: Folgende FPGA-Pins wurden an die Pinleisten geführt:.v C0 E0 F J0 K K L0 M N0 P R0 T U0 V W0 GND SV 0 0 P R T U 0 V W GND Vcc_Bank C E F K0 J K L M N Vcc_Bank F G H J K L M N P R T U V W Y GND SV 0 0.V F G H J K L M N P R T U V 0 W Y GND Vcc_Bank AB AB AB AB0 AB AB AB AB AB SV 0 0.V AA AA AA AA0 Y AA AA AA AA Die detaillierten Pinbezeichungen sind im Anhang A aufgeführt. Abmessungen: Symbol Maß (mm) A 0. B.0 C.0 SV JTAG Done D. E. B C D F. G. H. I. Button SV E LED LED F SV G A H I BitRecords FPGA Modul XCSLX_V.0, Mai0
3 Anhang A: PinOut SV SV Pinleiste FPGA Pinleiste FPGA Pin # Pin # Bank Pinbezeichnung Pin # Pin # Bank Pinbezeichnung.V Vcc_Bank Vcc_Bank.V C0 IO_LP_ F IO_L0N_ C IO_LN_ F IO_L0P_ E0 IO_LP_ G IO_LN_ E IO_LN_ G IO_LP_ F IO_LP_ H IO_LN_ F IO_LN_ H IO_LP_ J0 IO_LP_GCLK_ J IO_LN_GCLK_ 0 K0 IO_L0P_GCLK_ 0 J IO_LP_GCLK_ K IO_L0N_GCLK0_ K IO_L0N_ J IO_LN_GCLK_ K IO_L0P_ K IO_LP_ L IO_LN_ K IO_LN_ L IO_LP_ L0 IO_LP_ M IO_LN_ L IO_LN_ M IO_LP_ M IO_LP_ N IO_LN_ M IO_LN_ N IO_LP_ N0 IO_LP_ P IO_LN_ 0 N IO_LN_ 0 P IO_LP_ P IO_LP_ R IO_LN_ P IO_LN_ R IO_LP_ R0 IO_LP_ T IO_LN_ R IO_LN_ T IO_LP_ T IO_L0P_ U IO_LN_ T IO_L0N_ U IO_LP_ U0 IO_LP_ V IO_LN_ U IO_LN_ V IO_LP_ V IO_LP_ W IO_LN_ 0 V IO_LN_ 0 W IO_LP_ W0 IO_L0P_ Y IO_LN_VREF_ W IO_L0N_ Y IO_LP_ GND GND GND GND SV OnBoard Pinleiste FPGA Pin # Pin # Bank Pinbezeichnung Signal Pin # Bank Pinbezeichnung Vcc_Bank LED B IO_L0N_.V LED C IO_LN_ AB IO_LN_ Taster A IO_LP_ AA IO_LP_ 0MHz Y IO_LN_GCLK_ AB IO_LN_ AA IO_LP_ Flash AB IO_LN_ D AB0 IO_LN_MOSI_ AA IO_LP_ Q AA0 IO_LP_DIN_ AB0 IO_LN_VREF_ C Y IO_LP_CCLK_ 0 AA0 IO_LP_ S T IO_LN_CSO_B_ AB IO_LN_GCLK_ Y IO_LP_GCLK_ AB IO_LN_GCLK0_ AA IO_LP_GCLK_ AB IO_LN_VREF_ AA IO_LP_ AB IO_LN_ AA IO_LP_ AB IO_LN_ BitRecords FPGA Modul XCSLX_V.0, Mai0
4 Anhang B: SPI Flash Konfiguration (Xilinx impact) legen sie bei Nutzung des Xilinx ISE Project Navigator vor Erzeugung der bit-datei die Konfigurationsrate für den SPI Flash PROM fest: Generate Programming File Process Properties Configuration Options Configuration Rate verbinden sie das Modul über ein JTAG Kabel mit dem Rechner und stellen sie die Spannungsversorgung her starten sie Xilinx impact und wählen sie den Boundary Scan Modus das Xilinx Spartan FPGA sollte erkannt werden erzeugen sie aus der bit-datei eine mcs-konfigurationsdatei für den Flash Speicher; wählen sie im Auswahldialog die Option Configure Single FPGA und als Speichergröße MBit BitRecords FPGA Modul XCSLX_V.0, Mai0
5 wählen sie nach einem Rechtsklick auf das FPGA-Icon die Option Add SPI/BPI Flash... und selektieren sie im folgenden Dialog die zu speichernde mcs-datei wählen sie den SPI Flash aus (SPI PROM MP) nach einem Rechtsklick auf das Flash-Icon können sie über die Option Program die Übertragung vornehmen wählen Sie für die Übertragung die Einstellungen Verify und Erase before Programming nach einer korrekten Übertragung wird das Programm jedesmal automatisch in das FPGA geladen, sobald die Spannungsversorgung hergestellt wird BitRecords FPGA Modul XCSLX_V.0, Mai0
BitRecords FPGA Modul XC6SLX9, April
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