Hardware Logik-Analysatoren

Größe: px
Ab Seite anzeigen:

Download "Hardware Logik-Analysatoren"

Transkript

1 Hardware Logik-Analysatoren Dr.-Ing. Matthias Sand Lehrstuhl für Informatik 3 (Rechnerarchitektur) Friedrich-Alexander-Universität Erlangen-Nürnberg WS 2010/2011 Hardware Logik-Analysatoren 1/

2 Übersicht Inhalt: Motivation Logik-Analysatoren Interner LA Weitere Debug-Möglichkeiten Hardware Logik-Analysatoren 2/

3 Motivation Problem Wie debugt man Hardware? Lösungsansätze Während der Modellierung: Simulation, später: Aufzeichnen der Signale an den Pins / auf dem Bus, spezielle Debug-/Test-Logiken als Teil der HW (z.b. Boundary Scan), bei ASICs auch maximal-invasiv. Hardware Logik-Analysatoren 3/

4 (Speicher-)Oszilloskope Prinzip Zeigen den Verlauf von Spannungspegeln über der Zeit an, Trigger dient der Synchronisation der Zeitbasis, typische Eigenschaften: wenige Kanäle, einfache, periodische Trigger, hohe Auflösung im Spannungsbereich. Hardware Logik-Analysatoren 4/

5 (Speicher-)Oszilloskope (2) Idee Für Digitaltechnik nur Logikpegel (bzw. Information über die Änderung derselben) nötig Einsparung von Ressourcen mehr Kanäle und komplexere Trigger möglich Logik-Analysatoren. Hardware Logik-Analysatoren 5/

6 Logik-Analysatoren Prinzip Speichere ständig Verläufe der Logik-Pegel aller interessanten Signale in FIFOs, Schieberegistern o.ä., warte am Anfang, bis FIFO gefüllt ist, vergleiche dann definierte FIFO-Position mit interessantem Signalwechselmuster ( Trigger ), sobald Trigger auftritt: unterbreche die Aufzeichnung, stelle die FIFO-Inhalte als Wellenform dar. Hardware Logik-Analysatoren 6/

7 Logik-Analysatoren (2) Geräte Früher: Komplettlösungen (von der Klemme bis zum Monitor), heute oft Teillösungen: Steuerung und Darstellung übernimmt normaler PC. Hardware Logik-Analysatoren 7/

8 Logik-Analysatoren: Abgreifklemme Hardware Logik-Analysatoren 8/

9 Logik-Analysatoren: Komplettsystem Hardware Logik-Analysatoren 9/

10 Logik-Analysatoren: Bus-Abgreifkarte Hardware Logik-Analysatoren 10/

11 Logik-Analysatoren: Client auf dem Bus Hardware Logik-Analysatoren 11/

12 Interner LA Unser Prototyp verfügt über eine interne LA-Logik, die die wesentliche Signale des lokalen Busses, die Signale der FIFO-Ansteuerung, die seriellen Eingangs-, Ausgangs- und Steuersignale aufzeichnen und auf sie triggern kann. Zusätzlich: externer Trigger (von Peer). Hardware Logik-Analysatoren 12/

13 Interner LA Struktur Hardware Logik-Analysatoren 13/

14 Interner LA Benutzerschnittstelle Kommunikation mit LA erfolgt über TCP/IP, einfaches, selbstdefiniertes Protokoll, Benutzerschnittstelle in Software (GTK+-GUI), gtkwave als Betrachter für Aufzeichnungen. Hardware Logik-Analysatoren 14/

15 Interner LA GUI-Hauptmenü Hardware Logik-Analysatoren 15/

16 Interner LA Wellenformbetrachter Hardware Logik-Analysatoren 16/

17 Interner LA Trigger-Position Ort in der FIFO des LA, an dem nach dem Trigger gesucht wird. CHANNELS Trigger Position Hardware Logik-Analysatoren 17/

18 Weitere Debug-Möglichkeiten Student-Error, interner Loopback, Test-Interrupt. Hardware Logik-Analysatoren 18/

19 Weitere Debug-Möglichkeiten (2) Student-Error Interrupt (Maske 0x80) und triggerbares Signal, bei Lesen aus leerer FIFO, Schreiben in volle FIFO, HW-Error-Check fehlgeschlagen. Hardware Logik-Analysatoren 19/

20 Weitere Debug-Möglichkeiten (3) FIFO-Zugriffsfehler Werden durch spezielle Flags in Kontrollregistern unterschieden: SW-Err Full (Reg. 0x10, Bit 15) Schreiben in volle Send-FIFO, HW-Err Empty (Reg. 0x10, Bit 14) Lesen aus leerer Send-FIFO, HW-Err Full (Reg. 0x14, Bit 15) Schreiben in volle Recv-FIFO, SW-Err Empty (Reg. 0x14, Bit 14) Lesen aus leerer Recv-FIFO, Hardware Logik-Analysatoren 20/

21 Weitere Debug-Möglichkeiten (4) HW-Error-Check Aktivieren mit Bit 13 in Register 0x0C, Hardware erzeugt Pseudo-Zufallsfolgen nach u.g. Algorithmus, gesendete und empfangene Bitströme werden mit Zufallsreihe verglichen, bei Abweichung: Auslösen von Student-Error und Setzen von entsprechendem Bit: HW-Err PSC (Reg. 0x10, Bit 13) vor Parallel-Seriell-Wandler, HW-Err SPC (Reg. 0x14, Bit 13) nach Seriell-Parallel- Wandler. Hardware Logik-Analysatoren 21/

22 Weitere Debug-Möglichkeiten (5) HW-Error-Check (Forts.) Schieberegister, in jedem Schritt wird ein Byte erzeugt, Initialwert ist 0x1ff. compare XOR Hardware Logik-Analysatoren 22/

23 Weitere Debug-Möglichkeiten (6) Interner Loopback Direkte Verbindung von SER-OUT mit SER-IN und READY-OUT mit READY-IN, per Software schaltbar, Register-Offset 0x0C, Bit 11. Hardware Logik-Analysatoren 23/

24 Weitere Debug-Möglichkeiten (7) Test-Interrupt Auslösen mit Bit 12 in Register 0x0C, Flanke von 0 1 erzeugt Interrupt, Maske für Test-Interrupt: 0x01. Hardware Logik-Analysatoren 24/

Busse. Dr.-Ing. Volkmar Sieh. Institut für Informatik 3: Rechnerarchitektur Friedrich-Alexander-Universität Erlangen-Nürnberg WS 2008/2009

Busse. Dr.-Ing. Volkmar Sieh. Institut für Informatik 3: Rechnerarchitektur Friedrich-Alexander-Universität Erlangen-Nürnberg WS 2008/2009 Busse Dr.-Ing. Volkmar Sieh Institut für Informatik 3: Rechnerarchitektur Friedrich-Alexander-Universität Erlangen-Nürnberg WS 2008/2009 Busse 1/40 2008-10-13 Übersicht 1 Einleitung 2 Bus-Konfiguration

Mehr

Hardware Leitungscodierung und Protokoll

Hardware Leitungscodierung und Protokoll Hardware Leitungscodierung und Protokoll Dr.-Ing. Matthias Sand Lehrstuhl für Informatik 3 (Rechnerarchitektur) Friedrich-Alexander-Universität Erlangen-Nürnberg WS 2009/2010 Hardware Leitungscodierung

Mehr

Aufgabe 1 Entwicklung einer Virtuellen Maschine

Aufgabe 1 Entwicklung einer Virtuellen Maschine Aufgabe 1 Entwicklung einer Virtuellen Maschine Rainer Müller Department Informatik 4 Verteilte Systeme und Betriebssysteme Friedrich-Alexander-Universität Erlangen-Nürnberg WS 2014/2015 R. Müller Entwicklung

Mehr

Self-aware Memory: Hardware-Prototyp eines Prozessorknotens

Self-aware Memory: Hardware-Prototyp eines Prozessorknotens Self-aware Memory: Hardware-Prototyp eines Prozessorknotens Robert Schelkle Universität Karlsruhe (TH) Institut für Technische Informatik (ITEC) Lehrstuhl für Rechnerarchitektur 24. März 2009 Robert Schelkle

Mehr

Aufgabe 2 - Erweiterung um PIC und Interrupts

Aufgabe 2 - Erweiterung um PIC und Interrupts Aufgabe 2 - Erweiterung um PIC und Interrupts Dr.-Ing. Volkmar Sieh Department Informatik 3: Rechnerarchitektur Friedrich-Alexander-Universität Erlangen-Nürnberg WS2010/2011 Aufgabe 2 - Erweiterung um

Mehr

Remote-Objekt-Überwachung. von Jan Schäfer und Matthias Merk

Remote-Objekt-Überwachung. von Jan Schäfer und Matthias Merk Remote-Objekt-Überwachung von Jan Schäfer und Matthias Merk Aufgabenstellung Steuerung von Sensoren zur Remote Objektüberwachung mit einem µc PIC16F874. Welcher Sensor hat gemeldet? Die Überwachung Mehrere

Mehr

Hardware Leitungscodierung und Protokoll

Hardware Leitungscodierung und Protokoll Hardware Leitungscodierung und Protokoll Dr.-Ing. Matthias Sand Lehrstuhl für Informatik 3 (Rechnerarchitektur) Friedrich-Alexander-Universität Erlangen-Nürnberg WS 2010/2011 Hardware Leitungscodierung

Mehr

Hardware PCI, PCIe und Bus-Bridges

Hardware PCI, PCIe und Bus-Bridges Hardware PCI, PCIe und Bus-Bridges Dr.-Ing. Matthias Sand Lehrstuhl für Informatik 3 (Rechnerarchitektur) Friedrich-Alexander-Universität Erlangen-Nürnberg WS 2010/2011 Hardware PCI, PCIe und Bus-Bridges

Mehr

Messtechnik zum I2C-Bus

Messtechnik zum I2C-Bus Wenn man Projekte mit mehreren Teilnehmern am i2c-bus aufbaut oder andere Strukturen, die kompliziert sind, dann lohnen sich Messgeräte zur Analyse des Geschehens auf dem Bus. Es werden hier alle Möglichkeiten

Mehr

Vortrag zum Ergebnis der Literaturrecherche. Fehlerinjektion mittels Trace-Architektur auf einem Mips-Prozessor. Matthias Brinker

Vortrag zum Ergebnis der Literaturrecherche. Fehlerinjektion mittels Trace-Architektur auf einem Mips-Prozessor. Matthias Brinker Vortrag zum Ergebnis der Literaturrecherche Fehlerinjektion mittels Trace-Architektur auf einem Mips-Prozessor Matthias Brinker Dresden, 27.10.2016 Gliederung 1. Einleitung und Motivation 2. Trace-Architektur

Mehr

Aufgabe 2 - Erweiterung um PIC und Interrupts

Aufgabe 2 - Erweiterung um PIC und Interrupts Aufgabe 2 - Erweiterung um PIC und Interrupts Rainer Müller Department Informatik 4 Verteilte Systeme und Betriebssysteme Friedrich-Alexander-Universität Erlangen-Nürnberg WS 2014/2015 R. Müller Erweiterung

Mehr

Die Mikroprogrammebene eines Rechners

Die Mikroprogrammebene eines Rechners Die Mikroprogrammebene eines Rechners Das Abarbeiten eines Arbeitszyklus eines einzelnen Befehls besteht selbst wieder aus verschiedenen Schritten, z.b. Befehl holen Befehl dekodieren Operanden holen etc.

Mehr

Computergestützte Ansteuerung digitaler Eisenbahnanlagen

Computergestützte Ansteuerung digitaler Eisenbahnanlagen Computergestützte Ansteuerung digitaler Eisenbahnanlagen Märklin Digital Paul Römer Agenda 2 Märklin & Märklin Digital Wissenswertes Bedienelemente Ansteuerung Steuercomputer Interface und Digitalstrom

Mehr

Serielle Schnittstellen

Serielle Schnittstellen Serielle Schnittstellen Grundbegriffe Seriell, Parallel Synchron, Asynchron Simplex, Halbduplex, Vollduplex Baudrate, Bitrate Serielle Datenübertragung Senden von Daten Bit für Bit 1 0 1 1 Serielle Datenübertragung

Mehr

TECHNISCHE HOCHSCHULE NÜRNBERG GEORG SIMON OHM Die Mikroprogrammebene eines Rechners Das Abarbeiten eines Arbeitszyklus eines einzelnen Befehls besteht selbst wieder aus verschiedenen Schritten, z.b. Befehl

Mehr

MikroController der 8051-Familie

MikroController der 8051-Familie i Dipl.-Ing. Roland Dilsch MikroController der 8051-Familie Aufbau, Funktion, Einsatz Vogel Buchverlag Inhaltsverzeichnis Vorwort 5 1 Was ist ein MikrocontroUer? 13 1.1 Aufbau eines Computers 13 1.2 Entstehung

Mehr

Aufnahme mit Cubase LE 6

Aufnahme mit Cubase LE 6 PowerMate 3 /CMS 3 Application Note 1 Aufnahme mit Cubase LE 6 Dieses Dokument beschreibt die Aufnahme einer Live-Veranstaltung über das DIGITAL AUDIO INTERFACE des PowerMate 3 /CMS 3. Als Vorbereitung

Mehr

DALI SCI RS232. Datenblatt. DALI RS232 Interface. Schnittstelle zur Kommunikation zwischen PC (oder einer SPS) und Modulen in einem DALI-Lichtsystem

DALI SCI RS232. Datenblatt. DALI RS232 Interface. Schnittstelle zur Kommunikation zwischen PC (oder einer SPS) und Modulen in einem DALI-Lichtsystem DALI SCI RS232 Datenblatt DALI RS232 Interface Schnittstelle zur Kommunikation zwischen PC (oder einer SPS) und Modulen in einem DALI-Lichtsystem Art. Nr. 22176438-HS ersetzt: Art. Nr. 86458525 (DIN-Rail)

Mehr

JX3-AI4 Versions-Update von V 1.02 auf V 1.03

JX3-AI4 Versions-Update von V 1.02 auf V 1.03 JX3-AI4 Versions-Update von V 1.02 auf V 1.03 Version 1.01 Juni 2009 / Printed in Germany Vorspann Version 1.01 Die Firma Jetter AG behält sich das Recht vor, Änderungen an Ihren Produkten vorzunehmen,

Mehr

Drücken Sie (später) bei Speichere Änderungen in der Bibliothek default? auf Nein.

Drücken Sie (später) bei Speichere Änderungen in der Bibliothek default? auf Nein. Kapitel 5 Ein Schieberegister besteht aus einer linearen Anordnung von Flipflops, die so miteinander verschaltet sind, dass jedes Flipflop den Zustand seines Vorgängers übernimmt und seinen eigenen Zustand

Mehr

Integrierte Schaltungen

Integrierte Schaltungen Integrierte Schaltungen Klassen von Chips: SSI (Small Scale Integrated) circuit: 1 bis 10 Gatter MSI (Medium Scale Integrated) circuit: 10 bis 100 Gatter LSI (Large Scale Integrated) circuit: 100 bis 100

Mehr

TCP/IP ASCII Schnittstelle Programmierhandbuch

TCP/IP ASCII Schnittstelle Programmierhandbuch TCP/IP ASCII Schnittstelle Programmierhandbuch Version 3.0 1. Einleitung Das IRTrans ASCII Format dient der Ansteuerung von IRTrans Modulen (über den irserver oder Ethernetmodule mit IRDB bzw. LAN Controller

Mehr

Praktikum Mikrocomputertechnik

Praktikum Mikrocomputertechnik TPU (Time Processor Unit) Die TPU ist ein Coprozessor für Timingaufgaben, sie arbeitet parallel zum Hauptprozessor (Host), um zum Beispiel PWM-Signale zu generieren. Die TPU besitzt eine Reihe festprogrammierter

Mehr

Serielle Schnittstelle

Serielle Schnittstelle Serielle Schnittstelle RS-232 ist ein Standard für eine bei Computern teilweise vorhandene serielle Schnittstelle, der in den frühen 1960er Jahren von dem US-amerikanischen Standardisierungskomitee Electronic

Mehr

Fachhochschule Kaiserslautern Fachbereich Angewandte Ingenieurwissenschaften WS2010/11. Zeitpunkt der Prüfung: 18.01.2011 Beginn: 10.

Fachhochschule Kaiserslautern Fachbereich Angewandte Ingenieurwissenschaften WS2010/11. Zeitpunkt der Prüfung: 18.01.2011 Beginn: 10. Lehrprozessor: Coldfire MCF-5272 Zeitpunkt der Prüfung: 18.01.2011 Beginn: 10.45 Uhr Raum: Aula Bearbeitungszeit: 180 Minuten Erlaubte Hilfsmittel: Gedrucktes Vorlesungsskript von Prof. Neuschwander mit

Mehr

Parameter Bedingungen Spezifikationen A/D-Wandlertyp

Parameter Bedingungen Spezifikationen A/D-Wandlertyp Kapitel 4 Sofern nicht anders vermerkt, gelten alle Angaben für 25 C. Analogeingabe A/D-Wandlertyp Eingangsspannungsbereich für lineare Operation, single-ended Eingangs-Common-Mode- Spannungsbereich für

Mehr

HDO8000. Messungen an Motoren und Power Conversion Applikationen mit hochauflösenden 8 Kanal-Oszilloskopen

HDO8000. Messungen an Motoren und Power Conversion Applikationen mit hochauflösenden 8 Kanal-Oszilloskopen HDO8000 Messungen an Motoren und Power Conversion Applikationen mit hochauflösenden 8 Kanal-Oszilloskopen DSO in Power Conversion und Motor Drive Applikationen? Beide Applikationen sind getrieben von der

Mehr

Handout zum Vortrag: Einfache integrierte digitale Schaltungen von Andreas Bock

Handout zum Vortrag: Einfache integrierte digitale Schaltungen von Andreas Bock Index: 0. Wiederholung Flip-Flop: 0.1 D-Flip-Flop 0.2 JK-FlipFlop 1. Schieberegister 1.1 einfaches Schieberegister 1.2 Schieberegister mit parallelen Ladeeingängen 2. Zähler 2.1 Asynchroner Dualzähler

Mehr

Praktikum Mikrorechner 9 (serielle Schnittstelle)

Praktikum Mikrorechner 9 (serielle Schnittstelle) Prof. G. Kemnitz Institut für Informatik, Technische Universität Clausthal 5. November 2014 1/13 Praktikum Mikrorechner 9 (serielle Schnittstelle) Prof. G. Kemnitz Institut für Informatik, Technische Universität

Mehr

Fakultät für Technik Bereich Informationstechnik Labor Bussysteme Versuch 2 CAN 1 Teilnehmer: Vorname Nachname Matrikel Nummer Datum:

Fakultät für Technik Bereich Informationstechnik Labor Bussysteme Versuch 2 CAN 1 Teilnehmer: Vorname Nachname Matrikel Nummer Datum: Fakultät für Technik Bereich Informationstechnik Versuch 2 CAN 1 Teilnehmer: Vorname Nachname Matrikel Nummer Datum: Inhalt 1 Vorbemerkungen... 3 1.1 Einleitung... 3 1.2 Ziel der Versuche... 3 2 Vorbereitung...

Mehr

PM4002L Hardwarebeschreibung

PM4002L Hardwarebeschreibung PM4002L Hardwarebeschreibung IBN INGENIEURBÜRO BERND NEUMANN GMBH Eichendorffstraße 23 D-47626 Kevelaer Tel. +49(0)170-813 84 87 Fax +49(0)2 08-4 09 07 08 Internet: http://www.ibn-gmbh.de Email: email@ibn-gmbh.de

Mehr

T est of 1GBit/s Fiber optical communication interfaces based on FlexRIO R Series

T est of 1GBit/s Fiber optical communication interfaces based on FlexRIO R Series T est of 1GBit/s Fiber optical communication interfaces based on FlexRIO R Series Inhalt 1. Einführung... 2 2. Anforderungen... 2 3. Komponenten... 3 3.1. PXI 7952R... 3 3.2. Fiber Optical Interface Module

Mehr

Tickt ihr Board noch richtig? Frequenzmessung durch ChipVORX als Ergänzung zum Boundary Scan Test. Dipl.-Ing. (FH) Martin Borowski

Tickt ihr Board noch richtig? Frequenzmessung durch ChipVORX als Ergänzung zum Boundary Scan Test. Dipl.-Ing. (FH) Martin Borowski Tickt ihr Board noch richtig? Frequenzmessung durch ChipVORX als Ergänzung zum Boundary Scan Test. Dipl.-Ing. (FH) Martin Borowski 05.03.205 05.03.205 Was ist ChipVORX? 05.03.205 3 Typische Testaufgaben

Mehr

Darstellung eines 1-Bit seriellen Addierwerks mit VHDL. Tom Nagengast, Mathias Herbst IAV 07/09 Rudolf-Diesel-Fachschule für Techniker

Darstellung eines 1-Bit seriellen Addierwerks mit VHDL. Tom Nagengast, Mathias Herbst IAV 07/09 Rudolf-Diesel-Fachschule für Techniker Darstellung eines 1-Bit seriellen Addierwerks mit VHDL Tom Nagengast, Mathias Herbst IAV 07/09 Rudolf-Diesel-Fachschule für Techniker Inhalt: 1. Verwendete Tools 1.1 Simili 3.1 1.2 Tina 2. Vorgehensweise

Mehr

Powernet EIB System. Aktor. C D Technische Daten: Versorgung extern

Powernet EIB System. Aktor. C D Technische Daten: Versorgung extern Produktname: Binärein-/ausgang 2/2fach 16 A REG Bauform: Reiheneinbau Artikel-Nr.: 0439 00 ETS-Suchpfad: Gira Giersiepen, Ein/Ausgabe, Binär/binär, Binärein-/ausgang 2/2fach REG Funktionsbeschreibung:

Mehr

Embedded Software. Praktikum. Licht- und Schlafphasenwecker Lukas Scharlau Timo Schwarte

Embedded Software. Praktikum. Licht- und Schlafphasenwecker Lukas Scharlau Timo Schwarte Embedded Software Praktikum Licht- und Schlafphasenwecker 12.01.2015 Lukas Scharlau Timo Schwarte Inhalt Einleitung... 3 Ansteuerung LED-Streifen...3 Ansteuerung Bewegungssensor...3 Soundausgabe... 4 Buttons

Mehr

Microcontroller Programmierung. Ein PDV-Vertiefungsprojekt von: Chr. Schulz, P. Simon und D. Stein Sommersemester 2005 Version 1.0

Microcontroller Programmierung. Ein PDV-Vertiefungsprojekt von: Chr. Schulz, P. Simon und D. Stein Sommersemester 2005 Version 1.0 Microcontroller Programmierung Ein PDV-Vertiefungsprojekt von: Chr. Schulz, P. Simon und D. Stein Sommersemester 2005 Version 1.0 Inhalt Einführung Die Hardware Die Schaltlogik Implementierung der Steuerung

Mehr

16. Elektronik-Stammtisch: Logic Analyzer

16. Elektronik-Stammtisch: Logic Analyzer 16. Elektronik-Stammtisch: Logic Analyzer Axel Attraktor e.v. 6. Mai 2013 Axel (Attraktor e.v.) 16. Elektronik-Stammtisch 6. Mai 2013 1 / 40 Was ist ein Logic Analyzer Messgerät für digitale Signale Spannungsverläufe

Mehr

Übersicht. Stewart Plattform. Präsentation des Robotik-Praktikums. Hendrik Burgdörfer Fabian Rühle

Übersicht. Stewart Plattform. Präsentation des Robotik-Praktikums. Hendrik Burgdörfer Fabian Rühle Übersicht Stewart Plattform Präsentation des Robotik-Praktikums Hendrik Burgdörfer Fabian Rühle Interdisziplinäres Zentrum für wissenschaftliches Rechnen Ruprecht - Karls Universität Heidelberg 07. Mai

Mehr

AVR-Mikrocontroller in BASCOM programmieren, Teil 2

AVR-Mikrocontroller in BASCOM programmieren, Teil 2 jean-claude.feltes@education.lu 1 AVR-Mikrocontroller in BASCOM programmieren, Teil 2 13. Interrupts 13.1 Externe Interrupts durch Taster Wenn Taster mittels Polling abgefragt werden, wie in Teil 1 beschrieben,

Mehr

Versuch D3: Busse, Speicher und Ampelsteuerung mit Speicher

Versuch D3: Busse, Speicher und Ampelsteuerung mit Speicher Versuch D3: Busse, Speicher und Ampelsteuerung mit Speicher Version D3_16 vom 25.05.2016 Ziel dieses Versuches: Entwicklung einer Ablaufsteuerung mit einem 32 * 4 bit Speicherbaustein, um eine flexible

Mehr

M-AX-16/C1 (Typ 37) Inhaltsverzeichnis 18-1 18. M-AX-16/C1

M-AX-16/C1 (Typ 37) Inhaltsverzeichnis 18-1 18. M-AX-16/C1 MAX6/C (Typ 37) Inhaltsverzeichnis 8 8. MAX6/C Zählermodul mit 3 Zählkanälen à 2Bit und integriertem InterruptController, Betriebsartenumschaltung per Software Funktionsbeschreibung 82 Blockschaltbild...

Mehr

Cyexplorer Handbuch Stand: Januar 2011 Convision Systems GmbH

Cyexplorer Handbuch Stand: Januar 2011 Convision Systems GmbH Cyexplorer Handbuch Stand: Januar 2011 Convision Systems GmbH Inhaltsverzeichnis 1. Einleitung 2 2. Registration und Ausbau des Servers 2 IP Discovery 2 Registration eines Servers 3 Abbau eines Servers

Mehr

Verkürzung von Entwurfszeiten

Verkürzung von Entwurfszeiten Verkürzung von Entwurfszeiten durch Matlab-basiertes HPC R. Fink, S. Pawletta Übersicht aktuelle Situation im ingenieurtechnischen Bereich Multi-SCEs als Konzept zur Verkürzung von Entwurfszeiten Realisierung

Mehr

Speicherregister/Latches (1) 1

Speicherregister/Latches (1) 1 Informationstechnik Digitaltechnik Speicherregister/Latches (1) 1 Typisch in der Mikroprozessortechnik ist, dass viele Signale gleichzeitig mit identischen Schaltungskomponenten verarbeitet werden. Beispiele:

Mehr

Adressbeispiele Binär Schalterbild

Adressbeispiele Binär Schalterbild Datenblatt Features Controller kann DMX 512 empfangen oder senden Bis zu 360W Schaltleistung (3x 5A bei 24V) 3 PWM Kanäle Onboard, 7-24V DMX 512 zu WS2801 fähig Bequem programmierbar über Fernbedienung

Mehr

Analoge Schnittstellen

Analoge Schnittstellen Universität Koblenz Landau Name:..... Institut für Physik Vorname:..... Hardwarepraktikum für Informatiker Matr. Nr.:..... Analoge Schnittstellen Versuch Nr. 8 Vorkenntnisse: Komponenten eines Mikrocontrollersystems,

Mehr

Quanton Manual (de) Datum: 20.06.2013 URL: http://wiki:8090/pages/viewpage.action?pageid=9928792 )

Quanton Manual (de) Datum: 20.06.2013 URL: http://wiki:8090/pages/viewpage.action?pageid=9928792 ) Datum: 20.06.2013 URL: http://wiki:8090/pages/viewpage.action?pageid=9928792 ) Inhaltsverzeichnis 1 quanton flight control rev. 1 3 1.1 Anschlüsse für Peripheriegeräte 3 1.1.1 Eingänge / Ausgänge 3 1.1.2

Mehr

Funktionstest Ti2CA Compact

Funktionstest Ti2CA Compact Funktionstest Ti2CA Compact Systemarchitektur Die einfache Ansteuerung, hohe Ausbaustufen, bei geringem Kostenbedarf sowie die hohe Störsicherheit durch kurze Leitungslängen sind wesentliche Vorteile der

Mehr

C4 Die SPI Schnittstelle

C4 Die SPI Schnittstelle C4 Die SPI Schnittstelle Einführung Motorola entwickelte die synchrone SPI-Master-Slave Schnittstelle, (Serial Periphal Interface) für die Kommunikation zwischen Mikrocontrollern. Ein ähnliches Bus System

Mehr

Automaten. Dr.-Ing. Volkmar Sieh. Institut für Informatik 3: Rechnerarchitektur Friedrich-Alexander-Universität Erlangen-Nürnberg SS 2011

Automaten. Dr.-Ing. Volkmar Sieh. Institut für Informatik 3: Rechnerarchitektur Friedrich-Alexander-Universität Erlangen-Nürnberg SS 2011 Automaten Dr.-Ing. Volkmar Sieh Institut für Informatik 3: Rechnerarchitektur Friedrich-Alexander-Universität Erlangen-Nürnberg SS 2011 Automaten 1/28 2012-02-29 Flip-Flops Frage: wie kann man Werte speichern?

Mehr

Grafik Soft. Version 2.0. Datum: Hersteller: mesics gmbh. Für Windows 98/ME/NT4.0/2000/XP Betriebssysteme

Grafik Soft. Version 2.0. Datum: Hersteller: mesics gmbh. Für Windows 98/ME/NT4.0/2000/XP Betriebssysteme Grafik Soft Version 2.0 Datum: 04.02.2004 Hersteller: mesics gmbh Für Windows 98/ME/NT4.0/2000/XP Betriebssysteme Inhalt: EINLEITUNG 3 INSTALLATION 4 DIE DATENBANK 4 EINEN NEUEN TEST AUFZEICHNEN 6 TESTS

Mehr

Prof. Dr.-Ing. H. Heuermann

Prof. Dr.-Ing. H. Heuermann Hochfrequenztechnik WS 2007/08 Prof. Dr.-Ing. H. Heuermann Oszilloskope Autor: Jihad Lyamani 1 Geschichte und Entwicklung: Als erstes soll die Frage geklärt werden, warum man ein Oszilloskop erfunden hat

Mehr

Weniger ist mehr. Funktion eines Triggers. Messen + Testen

Weniger ist mehr. Funktion eines Triggers. Messen + Testen Messen + Testen Weniger ist mehr Ein Oszilloskop ist dumm, es unterscheidet nicht die Relevanz der Daten. Um der erfassten Datenflut Herr zu werden fischt der geschickte Anwender die relevanten Daten mit

Mehr

luxcontrol-lichtsteuerungen DALI-Interface DALI Interface RS232 PS/S PC-Schnittstellenmodul für DALI-Systeme

luxcontrol-lichtsteuerungen DALI-Interface DALI Interface RS232 PS/S PC-Schnittstellenmodul für DALI-Systeme Interface RS232 PS/S PC-Schnittstellenmodul für -Systeme Produktbeschreibung Vereint Schnittstellenmodul und -Stromversorgung Integrierte 240 ma Stromversorgung für -Betriebsgeräte oder -Steuermodule ohne

Mehr

E i s e n b a h n f r e u n d e K r a i c h g a u e. V. Datenübertragung. mit dem RS485

E i s e n b a h n f r e u n d e K r a i c h g a u e. V. Datenübertragung. mit dem RS485 E i s e n b a h n f r e u n d e K r a i c h g a u e. V. Datenübertragung mit dem RS485 Dezember 2007 E i s e n b a h n f r e u n d e K r a i c h g a u e. V. Datenübertragung mit dem RS485 herausgegeben

Mehr

Hardware Praktikum 2008

Hardware Praktikum 2008 HaPra 2008 - Versuchsreihe 5 - ALU Hardware Praktikum 2008 Prof. Dr. H.-J. Wunderlich Dipl.-Inf. M. Imhof Dipl.-Inf. S. Holst Agenda Die HaPra-CPU Eine kleine Übersicht VHDL Projekt-Organisation Entwurf

Mehr

VHDL Synthese. Dr.-Ing. Matthias Sand. Lehrstuhl für Informatik 3 (Rechnerarchitektur) Friedrich-Alexander-Universität Erlangen-Nürnberg WS 2009/2010

VHDL Synthese. Dr.-Ing. Matthias Sand. Lehrstuhl für Informatik 3 (Rechnerarchitektur) Friedrich-Alexander-Universität Erlangen-Nürnberg WS 2009/2010 VHDL Synthese Dr.-Ing. Matthias Sand Lehrstuhl für Informatik 3 (Rechnerarchitektur) Friedrich-Alexander-Universität Erlangen-Nürnberg WS 2009/2010 VHDL Synthese 1/36 2009-11-02 Inhalt Begriff Arten Kombinatorische

Mehr

Übungen zu Rechnerkommunikation Wintersemester 2010/2011 Übung 8

Übungen zu Rechnerkommunikation Wintersemester 2010/2011 Übung 8 Übungen zu Rechnerkommunikation Wintersemester 2010/2011 Übung 8 Mykola Protsenko, Jürgen Eckert PD. Dr.-Ing. Falko Dressler Friedrich-Alexander d Universität Erlangen-Nürnberg Informatik 7 (Rechnernetze

Mehr

HARDWARE-PRAKTIKUM. Versuch L-1. Schaltnetze. Fachbereich Informatik. Universität Kaiserslautern

HARDWARE-PRAKTIKUM. Versuch L-1. Schaltnetze. Fachbereich Informatik. Universität Kaiserslautern HARDWARE-PRAKTIKUM Versuch L-1 Schaltnetze Fachbereich Informatik Universität Kaiserslautern Seite 2 Versuch L-1 Versuch L-1 Dieser Versuch behandelt einfache Schaltnetze, die mit Hilfe von PALs aufgebaut

Mehr

JX6-INT1 Versions Update von V1.00 auf V1.24

JX6-INT1 Versions Update von V1.00 auf V1.24 JX6-INT1 Versions Update von V1.00 auf V1.24 Auflage 1.00 16. September 2002 / Printed in Germany Versions Update - 16. September 2002 JX6-INT1 - von V1.00 auf V1.24 Die Firma JETTER AG behält sich das

Mehr

Serielle Kommunikation mit dem Arduino. Teil 1: Das Serial Peripheral Interface (SPI)

Serielle Kommunikation mit dem Arduino. Teil 1: Das Serial Peripheral Interface (SPI) Serielle Kommunikation mit dem Arduino Teil 1: Das Serial Peripheral Interface (SPI) Axel Attraktor e.v. 4. Juni 2012 Axel (Attraktor e.v.) 5. Arduino-Stammtisch 4. Juni 2012 1 / 25 Serielle Kommunikation

Mehr

Programmierbeispiel RS485- Kommunikation

Programmierbeispiel RS485- Kommunikation Programmierbeispiel RS485- Kommunikation NANOTEC ELEKTRONIK GmbH & Co. KG Kapellenstr. 6 D-85622 Feldkirchen b. München Tel. +49 (0)89-900 686-0 Fax +49 (0)89-900 686-50 Email info@nanotec.de 1 / 6 Ausgabe:

Mehr

56. UKW Tagung Weinheim 2011 Zeitsynchronisation mit NTP (Network Time Protocol)

56. UKW Tagung Weinheim 2011 Zeitsynchronisation mit NTP (Network Time Protocol) (Network Time Protocol) Warum NTP? Grundlagen von NTP Netzarchitektur Zeitserver (Einzelsystem, Pool) Clientkonfiguration UNIX / Linux Clientkonfiguration Windows Literaturquellen Diskussion Referent:

Mehr

CRC Einführung. Version: Datum: Autor: Werner Dichler

CRC Einführung. Version: Datum: Autor: Werner Dichler CRC Einführung Version: 0.0.1 Datum: 04.03.2013 Autor: Werner Dichler Inhalt Inhalt... 2 Polynom-Division... 3 Allgemein... 3 Beispiel... 3 CRC Grundlagen... 4 Allgemein... 4 Dyadische Polynom-Division...

Mehr

Die RS Schnittstelle

Die RS Schnittstelle Die RS232 -. Schnittstelle Referat in der Vorlesung Rechnerstrukturen C.Wehland ; A.Gerst Inhalt Überblick serielle PC-Schnittstelle Übertragungsparameter Signale der seriellen Schnittstelle Register der

Mehr

Wer möchte, kann sein Programm auch auf echter Hardware testen

Wer möchte, kann sein Programm auch auf echter Hardware testen U4 3. Übungsaufgabe U4 3. Übungsaufgabe Grundlegendes zur Übung mit dem AVR-μC Register I/O-Ports AVR-Umgebung Peripherie U4.1 U4-1 Grundlegendes zur Übung mit dem AVR-mC U4-1 Grundlegendes zur Übung mit

Mehr

Parallel-IO. Ports am ATmega128

Parallel-IO. Ports am ATmega128 Parallel-IO Ansteuerung Miniprojekt Lauflicht Ports am ATmega128 PortE (PE7...PE0) alternativ, z.b. USART0 (RS232) 1 Pin von PortC Port C (PC7...PC0) 1 Parallel-IO-Port "Sammelsurium" verschiedener Speicher

Mehr

Asynchrone Schaltungen

Asynchrone Schaltungen Asynchrone Schaltungen Dr.-Ing. Volkmar Sieh Institut für Informatik 3: Rechnerarchitektur Friedrich-Alexander-Universität Erlangen-Nürnberg SS 2013 Asynchrone Schaltungen 1/25 2013/07/18 Asynchrone Schaltungen

Mehr

Speicherung digitaler Signale

Speicherung digitaler Signale Speicherung digitaler Signale von Fabian K. Grundlagen Flipflops Bisher: Schaltungen ohne Speichermöglichkeit Jetzt: Speichermöglichkeit durch Flipflops Flipflops Grundlagen Flipflops Was sind Flipflops?

Mehr

Serieller S-Bus reduziertes Protokoll (Level 1)

Serieller S-Bus reduziertes Protokoll (Level 1) 2 Serieller S-Bus reduziertes Protokoll (Level 1) Inhalt - S-Bus RS485 Netzwerk - Beispielaufbau - Reduziertes S-Bus-Protokoll - PG5 Projektvorbereitung - Master / Konfiguration und Programmierung - Master

Mehr

Name: ES2 Klausur Thema: ARM 25.6.07. Name: Punkte: Note:

Name: ES2 Klausur Thema: ARM 25.6.07. Name: Punkte: Note: Name: Punkte: Note: Hinweise für das Lösen der Aufgaben: Zeit: 95 min. Name nicht vergessen! Geben Sie alle Blätter ab. Die Reihenfolge der Aufgaben ist unabhängig vom Schwierigkeitsgrad. Erlaubte Hilfsmittel

Mehr

Zur Startseite Zur Artikelübersicht Der RS485 Bus

Zur Startseite Zur Artikelübersicht Der RS485 Bus Zur Startseite Zur Artikelübersicht Der RS485 Bus Einleitung Der RS485 Bus ist eine sehr interessante Schnittstelle. Dieser Artikel erklärt was der RS485 Bus eigentlich ist, wie er funktioniert und wo

Mehr

Weiterentwicklung der Systemarchitektur des unbemannten Forschungsflugzeugs UlltRA evo Data Distribution Controller

Weiterentwicklung der Systemarchitektur des unbemannten Forschungsflugzeugs UlltRA evo Data Distribution Controller 30.09.2008 Weiterentwicklung der des unbemannten Forschungsflugzeugs UlltRA evo Data Distribution Controller mail@juergentreml.de www.juergentreml.de Betreuung Christian Rößler, Dipl.-Ing. Lehrstuhl für

Mehr

CoreSight-Zugang auf dem ZedBoard. Alex Bereza

CoreSight-Zugang auf dem ZedBoard. Alex Bereza Alex Bereza Dresden, Gliederung 1. Aufgabenstellung 2. Das 3. CoreSight 4. Trace-Pakete 5. Implementierung des IP-Cores 6. Fazit 7. Quellen Folie Nr. 2 von 26 1. Aufgabenstellung ARM-Prozessor des verfügt

Mehr

Elektronikpraktikum - SS 2014 H. Merkel, D. Becker, S. Bleser, M. Steinen Gebäude 02-413 (Anfängerpraktikum) 1. Stock, Raum 430

Elektronikpraktikum - SS 2014 H. Merkel, D. Becker, S. Bleser, M. Steinen Gebäude 02-413 (Anfängerpraktikum) 1. Stock, Raum 430 Elektronikpraktikum - SS 24 H. Merkel, D. Becker, S. Bleser, M. Steinen Gebäude 2-43 (Anfängerpraktikum). Stock, Raum 43 Serie 7: Digitale Schaltungen./.7.24 I. Ziel der Versuche Verständnis für Entwurf

Mehr

Verwendung des EASY Mode mit Demo FB für SIMATIC Step7

Verwendung des EASY Mode mit Demo FB für SIMATIC Step7 Produkt: OIT...-F113-B12-CB. Autor: Ralf Rössling / Jürgen Warkus Dokumentversion: 1.1 Datum: 05.09.2012 Verwendung des EASY Mode mit Demo FB für SIMATIC Step7 Um den EASY Mode am OIT System zu nutzen

Mehr

Serielle Datenübertragung mit dem Schnittstellenbaustein 8251

Serielle Datenübertragung mit dem Schnittstellenbaustein 8251 Serielle Datenübertragung mit dem Schnittstellenbaustein 8251 2 Inhaltsverzeichnis Thema Seite Inhaltsverzeichnis 2 Einleitung 2 Serielle Datenübertragung 3 Der serielle Schnittstellenbaustein 8251 4 Beispielprogramm

Mehr

Wireless LAN Meßverfahren

Wireless LAN Meßverfahren Wireless LAN 802.11 Meßverfahren Ad-hoc-Netzwerke für mobile Anlagen und Systeme 199. PTB-Seminar und Diskussionssitzung FA 9.1 Meßverfahren der Informationstechnik Berlin, 3. - 4.11.2004 Martin Weiß Rohde

Mehr

IPEmotion CAN Bus Traffic Speichern, Auswerten, Simulieren PM 04.05.2016 (V2.3)

IPEmotion CAN Bus Traffic Speichern, Auswerten, Simulieren PM 04.05.2016 (V2.3) IPEmotion CAN Bus Traffic Speichern, Auswerten, Simulieren PM 04.05.2016 (V2.3) Inhalt 1. Applikationen 2. Funktionsübersicht: Protokolle PlugIn 3. Traffic speichern 4. Traffic analysieren 5. Traffic simulieren

Mehr

instabus EIB System Sensor

instabus EIB System Sensor Produktname: Binäreingang / 4fach / 24 V / wassergeschützt Bauform: Aufputz Artikel-Nr.: 0565 00 ETS-Suchpfad: Eingabe, Binäreingang 4fach, Gira Giersiepen, Binäreingang 4fach/24 V WG AP Funktionsbeschreibung:

Mehr

SER4-FIFO RS422/485. Technische Beschreibung

SER4-FIFO RS422/485. Technische Beschreibung Computertechnik GmbH SER4-FIFO RS422/485 Technische Beschreibung Bestellnummern: 404.216553.400 4 SER4-FIFO RS422/485 404.216553.200 6 SER2-FIFO RS422/485 Ihr Ansprechpartner: 1996 by Janich & Klass Computertechnik

Mehr

Grundkurs Routing im Internet mit Übungen

Grundkurs Routing im Internet mit Übungen Grundkurs Routing im Internet mit Übungen Falko Dressler, Ursula Hilgers {Dressler,Hilgers}@rrze.uni-erlangen.de Regionales Rechenzentrum der FAU 1 Tag 4 Router & Firewalls IP-Verbindungen Aufbau von IP

Mehr

Getaktete Schaltungen

Getaktete Schaltungen Getaktete Schaltung DST SS23 - Flipflops und getaktete Schaltung P. Fischer, TI, Uni Mannheim, Seite Sequtielle Logik Zum Speichern des Zustands eines Systems sind Speicherelemte notwdig Abhängig vom Zustand

Mehr

High Definition AV Inhaltsschutz für Netzwerkübertragungen

High Definition AV Inhaltsschutz für Netzwerkübertragungen High Definition AV Inhaltsschutz für Netzwerkübertragungen Bildquelle: Tamedia/Cinetext 1 High-bandwidth Digital Content Protection (HDCP) HDCP 1.x 2 HDCP Lizenzierung Hersteller die HDCP verschlüsselte

Mehr

Fakultät für Technik Bereich Informationstechnik Labor Bussysteme Versuch 2 CAN-Bus Teilnehmer: Vorname Nachname Matrikel Nummer Datum:

Fakultät für Technik Bereich Informationstechnik Labor Bussysteme Versuch 2 CAN-Bus Teilnehmer: Vorname Nachname Matrikel Nummer Datum: Fakultät für Technik Bereich Informationstechnik Versuch 2 CAN-Bus Teilnehmer: Vorname Nachname Matrikel Nummer Version 2012.00 Datum: Inhalt 1 Vorbemerkungen... 3 1.1 Einleitung... 3 1.2 Ziele des Versuchs...

Mehr

Wählen Sie eine Menüoption, um weitere Informationen zu erhalten:

Wählen Sie eine Menüoption, um weitere Informationen zu erhalten: Verwenden Sie das, um Einstellungen für Druckaufträge zu ändern, die über die serielle Schnittstelle an den Drucker gesendet werden (entweder Standard Seriell oder Seriell Option ). Wählen Sie eine

Mehr

eps Network Services HMI-Alarme

eps Network Services HMI-Alarme 09/2005 HMI-Alarme eps Network Services HMI-Alarme Diagnoseanleitung Gültig für: Software Softwarestand eps Network Services 4.1 eps Network Services, Diagnoseanleitung (DA) - Ausgabe 09/2005 1 HMI-Alarme

Mehr

Chiptunes Wie musikalisch ist mein Mikrocontroller?

Chiptunes Wie musikalisch ist mein Mikrocontroller? Institut für Elektrische Messtechnik und Grundlagen der Elektrotechnik Chiptunes Wie musikalisch ist mein Mikrocontroller? Martin Wenske WS 2011/2012 09.01.2012 Betreuer: Timo Klingeberg www.emg.tu-bs.de

Mehr

Rechnerarchitektur Atmega 32. 1 Vortrag Atmega 32. Von Urs Müller und Marion Knoth. Urs Müller Seite 1 von 7

Rechnerarchitektur Atmega 32. 1 Vortrag Atmega 32. Von Urs Müller und Marion Knoth. Urs Müller Seite 1 von 7 1 Vortrag Atmega 32 Von Urs Müller und Marion Knoth Urs Müller Seite 1 von 7 Inhaltsverzeichnis 1 Vortrag Atmega 32 1 1.1 Einleitung 3 1.1.1 Hersteller ATMEL 3 1.1.2 AVR - Mikrocontroller Familie 3 2 Übersicht

Mehr

Vortrag zum Hauptseminar Hardware/Software Co-Design

Vortrag zum Hauptseminar Hardware/Software Co-Design Fakultät Informatik Institut für Technische Informatik, Professur für VLSI-Entwurfssysteme, Diagnostik und Architektur Vortrag zum Hauptseminar Hardware/Software Co-Design Robert Mißbach Dresden, 02.07.2008

Mehr

Kurzanleitung: 1. Anschüsse. MWCLightRGB 2013 by VoBo & HaDi-RC. HW-Version SW-Version 1.2x

Kurzanleitung: 1. Anschüsse. MWCLightRGB 2013 by VoBo & HaDi-RC. HW-Version SW-Version 1.2x Kurzanleitung: 1. Anschüsse IN: 3,8 bis 5 Volt!(nicht 5,5 V oder 6 V!) OUT: Anschlüsse für WS2812 LED-Bänder (6/9 LED s / Arm) RC1: RC-Kanal -> Auswahl der Funktion/Lichtmuster RC2: RC-Kanal -> Auswahl

Mehr

Funktions-Blockschaltbild des Mikroprozessors 8085

Funktions-Blockschaltbild des Mikroprozessors 8085 INTA RST5.5 RST7.5 Zeit und Ablaufsteuerung READY HOLD RESET IN Adressenbus AdressenDatenBus FunktionsBlockschaltbild des Mikroprozessors 8085 READY HOLD 4OLDA IVTR I NTA I Daten werden mit der steiqenden

Mehr

Boundary Scan Days 2009

Boundary Scan Days 2009 Boundary Scan Days 2009 Einsatz von Virtual JTAG (Altera) für Flash - & EEPROM - Programmierung Dammert Tobias & Knüppel Lars Nokia Siemens Networks GmbH & Co. KG Standort Bruchsal Test Engineering 1 Nokia

Mehr

Hardware PC DDC JP Elektronik GmbH

Hardware PC DDC JP Elektronik GmbH Hardware JP Elektronik GmbH Hardware für PC-DDC Regler J+M. Pascher Seite 1 von 8 Inhalt: Beschreibung Net-IO Box Seite 2 Beschreibung Box6F Seite 3 Beschreibung BoxOUT6 Seite 4 Beschreibung Raummanager

Mehr

17. März IGsHA Sitzung 2.

17. März IGsHA Sitzung 2. 1 17. März 2016 - IGsHA Sitzung 2 2 Funktionen Solar-Log Alle Funktionen in einem Gerät integriert Monitoring Einspeisemanagement Direktvermarktung Smart Energy 3 Solar-Log All-in-One Komponentendatenbank

Mehr

a. Flipflop (taktflankengesteuert) Wdh. Signalverläufe beim D-FF

a. Flipflop (taktflankengesteuert) Wdh. Signalverläufe beim D-FF ITS Teil 2: Rechnerarchitektur 1. Grundschaltungen der Digitaltechnik a. Flipflop (taktflankengesteuert) Wdh. Signalverläufe beim D-FF b. Zähler (Bsp. 4-Bit Zähler) - Eingang count wird zum Aktivieren

Mehr

Handbuch. S/ATA PCI Card 1+1. deutsch.

Handbuch. S/ATA PCI Card 1+1. deutsch. Handbuch S/ATA PCI Card 1+1 deutsch Handbuch_Seite 2 Inhalt 1. Einleitung, Eigenschaften, Lieferumfang 3 2. Software Installation 4 Änderungen des Handbuchs bleiben vorbehalten, auch ohne vorherige Ankündigung.

Mehr

AVR-Mikrocontroller in BASCOM programmieren

AVR-Mikrocontroller in BASCOM programmieren jean-claude.feltes@education.lu 1 AVR-Mikrocontroller in BASCOM programmieren Der IC-Bus (TWI-Interface) Allgemeines Spezifikationen des IC-Busses: http://www.nxp.com/acrobat_download/literature/9398/39311.pdf

Mehr