Inhaltsverzeichnis. Vorwort...VII. Vorwort zur 2. Auflage... IX. Inhaltsverzeichnis... XI

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1 Vorwort...VII Vorwort zur 2. Auflage... IX Inhaltsverzeichnis... XI 1 Grundlagen Mikroprozessoren, Mikrocontroller, Signalprozessoren und SoC PC-Systeme Eingebettete und ubiquitäre Systeme Leistungsmessung und Leistungsvergleich Grundlegende Prozessortechniken Befehlssatzarchitekturen Prozessorarchitektur, Mikroarchitektur und Programmiermodell Datenformate Adressraumorganisation Befehlssatz Befehlsformate Adressierungsarten CISC- und RISC-Prinzipien Befehlssatzbeispiele Frühe RISC-Rechner Das Berkeley RISC-Projekt Die DLX-Architektur Einfache Prozessoren und Prozessorkerne Von-Neumann-Prinzip Grundlegender Aufbau eines Mikroprozessors Einfache Implementierungen Pipeline-Prinzip Befehls-Pipelining Grundlegende Stufen einer Befehls-Pipeline Die DLX-Pipeline Pipeline-Konflikte Datenkonflikte und deren Lösungsmöglichkeiten Steuerflusskonflikte und deren Lösungsmöglichkeiten...62

2 XII Inhaltsverzeichnis Sprungzieladress-Cache Statische Sprungvorhersagetechniken Strukturkonflikte und deren Lösungsmöglichkeiten Ausführung in mehreren Takten Weitere Aspekte des Befehls-Pipelining Mikrocontroller Abgrenzung zu Mikroprozessoren Anwendungsfelder Prozesssteuerung Steuerung von Bedienelementen Leistungsklassen und industrielle Mikrocontrollerfamilien Auswahlkriterien für den Einsatz von Mikrocontrollern Software-Entwicklung Forschungstrends Systems-on-Chip (SoC) Energiespar-Techniken Java und Java-Prozessoren für eingebettete Systeme Selbstorganisation und Organic Computing Mikrocontroller-Komponenten Prozessorkerne Ein-/Ausgabeeinheiten Anbindung an den Prozessorkern Digitale parallele Ein-/Ausgabeeinheiten Digitale serielle Ein-/Ausgabeeinheiten Wandlung zwischen analogen und digitalen Signalen Zeitgeberbasierte Einheiten Zähler und Zeitgeber Capture-und-Compare-Einheit Pulsweitenmodulator Watchdog-Einheit Echtzeit-Ein-/Ausgabeeinheiten Speicher Festwertspeicher Schreib-/Lesespeicher Unterbrechungssteuerung DMA Erweiterungsbus Beispiele verschiedener Mikrocontroller ATmega128 ein kompakter Mikrocontroller Prozessorkern Unterbrechungsbehandlung Speicher und Adressraum Ein-/Ausgabeeinheiten und Zähler/Zeitgeber

3 XIII Erweiterungsbus MC68332 ein Mikrocontroller mittlerer Leistung Prozessorkern Unterbrechungsbehandlung Speicher und Adressraum Ein-/Ausgabeeinheiten und Zähler/Zeitgeber Erweiterungsbus PXA255 ein Hochleistungs-Mikrocontroller Prozessorkern Unterbrechungsbehandlung Speicher und Adressraum Ein-/Ausgabeeinheiten und Zähler/Zeitgeber Erweiterungsbus MCore optimiert für niedrigen Energieverbrauch Reduktion der Busaktivitäten und Erhöhung der Code-Dichte Statisches Power-Management Dynamisches Power-Management Komodo ein Forschungs-Mikrocontroller Prozessorkern Echtzeit-Scheduling Unterbrechungsbehandlung Anbindung der peripheren Komponenten Evaluierungs-Ergebnisse Weiterführende Konzepte Hochperformante Mikroprozessoren Von skalaren RISC- zu Superskalarprozessoren Komponenten eines superskalaren Prozessors Superskalare Prozessor-Pipeline Präzisierung des Begriffs superskalar Die VLIW-Technik Die EPIC-Technik Vergleich der Superskalar- mit der VLIW- und der EPIC-Technik Die Superskalartechnik Befehlsbereitstellung Code-Cache-Speicher Befehlsholestufe Trace Cache Sprungvorhersage und spekulative Ausführung Grundlagen Dynamische Sprungvorhersagetechniken Ein- und Zwei-Bit-Prädiktoren Korrelationsprädiktoren Zweistufig adaptive Prädiktoren gselect- und gshare-prädiktoren...315

4 XIV Inhaltsverzeichnis Hybridprädiktoren Zuverlässigkeitsabschätzung Weitere Prädiktoren zur Interferenzverringerung Prädikation Mehrpfadausführung Vorhersage bedingter Sprungbefehle mit indirekter Adressierung Stand der Technik Sprungvorhersage mit hoher Bandbreite Decodierung und Registerumbenennung Decodierung Registerumbenennung Befehlszuordnung Ausführungsstufen Gewährleistung der sequenziellen Programmsemantik Rückordnungsstufe Präzise Unterbrechungen Rückordnungspuffer Verzicht auf die Sequenzialisierung bei der Rückordnung Speicherverwaltung Speicherhierarchie Register und Registerfenster Virtuelle Speicherverwaltung Cache-Speicher Grundlegende Definitionen Grundlegende Techniken Verringern der Fehlzugriffsrate Verringern des Fehlzugriffsaufwandes Verringern der Cache-Zugriffszeit bei einem Treffer Cache-Kohärenz und Speicherkonsistenz Busschnüffeln und MESI-Protokoll Speicherkonsistenz Beispiele für Mikroprozessoren PentiumPro, Pentium II und Pentium III Athlon Pentium Zukunftstechniken für Mikroprozessoren Technologieprognosen Stand der Technik und Grenzen heutiger Prozessortechniken Prozessortechniken zur Erhöhung des Durchsatzes eines Kontrollfadens Weiterentwicklungen des Trace Cache Datenabhängigkeits-, Adress- und Wertespekulationen

5 XV Vielfach superskalare Prozessoren Prozessortechniken zur Erhöhung des Durchsatzes einer mehrfädigen Last Chip-Multiprozessor Prozessor-Speicher-Integration Mehrfädige Prozessoren Kontrollfadenspekulation Multiskalarer Prozessor Trace-Prozessor Weitere Techniken der Kontrollfadenspekulation Zusammenfassung Literatur Sachverzeichnis...439