Digitaltechnik. 6 Speicherelemente. Revision 1.4
|
|
- Mathilde Gerber
- vor 8 Jahren
- Abrufe
Transkript
1 Digitaltechnik 6 Speicherelemente A Revision 1.4
2 Übersicht Adressen Read-Only Memory ROM Random Access Memory RAM Datenbusse Caches
3 Speicher Memory ROM: read-only memory RAM: random-access memory (besser wäre read and write memory) SRAM: static RAM Zustand bleibt solange Strom anliegt DRAM: dynamic RAM implementiert mit Kondensatoren Zustand verliert sich ohne regelmässiges Auffrischen (engl. refresh) Digitaltechnik Kapitel 6: Speicherelemente 3
4 RAM in PCs 30 pin SIMM 72 pin SIMM MicroDIMM 184 pin RAMBus RIMM 100 pin DIMM 72 pin SODIMM 144 pin SDRAM SODIMM 200 pin DDR SODIMM 200 pin DDR-2 SODIMM 168 pin SDRAM DIMM 184 pin DDR DIMM 240 pin DDR-2 DIMM Digitaltechnik Kapitel 6: Speicherelemente 4
5 Adressen RAM/ROM-Chips speichern viele (Milliarden) Bits WE DATA Speicher Adresse Diese Bits werden durch Adressen unterschieden Die Adresse wird binärcodiert übergeben WE: Lesen/Schreiben Die Datenleitungen werden sowohl zum Lesen als auch zum Schreiben verwendet Digitaltechnik Kapitel 6: Speicherelemente 5
6 Aufbau Decoder 2 4 Decoder 2 Adresse RAM/ROM-Chips sind als 2D-Matrix aufgebaut Die Adresse wird in Zeilen- und Spaltenadresse aufgeteilt (engl. row und column) Die Binärcodierung wird durch einen Decoder in eine unäre Codierung umgewandelt Digitaltechnik Kapitel 6: Speicherelemente 6
7 Exkurs: Decoder Spezifikation n-bit Decoder: dec : {0, 1} n {0, 1} 2n mit i {0,... 2 n 1}. dec(x) i x = i Beispiel: dec(000) = dec(001) = dec(111) = Digitaltechnik Kapitel 6: Speicherelemente 7
8 Exkurs: Decoder Implementierung: b 1 o 1 1-Bit Decoder o 3 o 2 b 0 o 0 b 0 o 1 1-Bit 1-Bit Decoder Decoder o 0 2-Bit Decoder Digitaltechnik Kapitel 6: Speicherelemente 8
9 Exkurs: Decoder Rekursionsschema: b n b n 1 b 1 b 0 n-bit Decoder o 2 n+1 1 o 2 n+1 2 o 2 n n-bit Decoder o 2n 1 o 2n 2 o 0 n + 1-Bit Decoder Digitaltechnik Kapitel 6: Speicherelemente 9
10 Read-Only Memory ROM Früher: Diodenmatrizen manuell verdrahtet PROM: programmable ROM EPROM: löschbar durch ultraviolettes Licht EEPROM: elektronisch löschbar Flash-EEPROM: USB-Sticks, Digitalkameras, IPODs,... Digitaltechnik Kapitel 6: Speicherelemente 10
11 ROM Modell in Verilog 5 module my rom16x7(input [3:0] address, output [6:0] data); reg [6:0] rom [3:0]; initial begin rom[0]= b ; // aehnliche Zeilen... rom[15]= b ; 10 end assign data=rom[address]; endmodule Digitaltechnik Kapitel 6: Speicherelemente 11
12 Ad: Rom Modell in Verilog Eigentlich nur Simulations-Modell, Implementierung des ROMs separat Timing mag interessant sein: assign #5 data =... Einfache kombinatorische Logik lässt sich als ROM implementieren EPROM/Flash: Programmierung durch Anlegen hoher Spannung (z.b. -12 V) Programmierbarkeit wird normalerweise nicht modelliert Digitaltechnik Kapitel 6: Speicherelemente 12
13 SRAM Zelle mit zwei Invertern Address Line Data Data Schreib- und lesbar Address Line wählt Zelle aus Zustand wird von den gekoppelten Invertern (Latch) gehalten Auslesen durch Vergleich von Data und Data Digitaltechnik Kapitel 6: Speicherelemente 13
14 SRAM Zelle in CMOS Address Line VDD GND Data Data Digitaltechnik Kapitel 6: Speicherelemente 14
15 DRAM DRAM verwendet die Kapazität von Kondensatoren einfacherer und regelmäßigerer Aufbau als SRAM hohe Integrationsdichte, günstige Fertigungskosten Aber: langsamerer schnelles aber teures SRAM für Cache Speicher (später) langsames aber billiges DRAM für Hauptspeicher Digitaltechnik Kapitel 6: Speicherelemente 15
16 Erinnerung: Kondensatoren 1 Ladung % Ladung Entladung Zeit Speichern elektrische Ladung für begrenzte Zeit Digitaltechnik Kapitel 6: Speicherelemente 16
17 DRAM Zelle Address Line GND Data Bit wird als Kapazität gespeichert und muss ständig aufgefrischt werden Digitaltechnik Kapitel 6: Speicherelemente 17
18 Datenbusse Anbindung mehrerer Spreicherchips: Speichermodul Speichermodul Prozessor Speichermodul Nein: I/O Pins sind teuer! Digitaltechnik Kapitel 6: Speicherelemente 18
19 Datenbusse Ziel: effektive Nutzung der teuren Verbindungsleitungen Idee: Daten- und Adressleitungen teilen! Speichermodul Speichermodul Speichermodul Prozessor Datenleitungen Adressleitungen Steuerleitungen Digitaltechnik Kapitel 6: Speicherelemente 19
20 Interface RAM-Chips Kontrollsignale: CS (Chip Select) aktiviert einen bestimmten RAM-Chip WE (Write Enable) OE (Output Enable) unaktiviert sind Ausgaben eines RAM-Chips im Tristate (Z) Schreiben durch Setzen von WE, Lesen durch Setzen von OE Interface Constraint: OE und WE sind nie gleichzeitig gesetzt Digitaltechnik Kapitel 6: Speicherelemente 20
21 Schreibzyklus CS W E OE Address Data valid Digitaltechnik Kapitel 6: Speicherelemente 21
22 Lesezyklus CS W E OE Address Data valid Digitaltechnik Kapitel 6: Speicherelemente 22
23 RAM-Modell in Verilog module my ram16x8(input [3:0] address, inout [7:0] data, input CS, WE, OE); 5 reg [7:0] ram [3:0]; assign data = (!CS &&!OE)? ram[address] : bzzzzzzzz; CS, WE) 10 if (! CS &&!WE) ram[address] <= data; endmodule Digitaltechnik Kapitel 6: Speicherelemente 23
24 Kaskadierung von RAM-Chips Address (6 bit wide) OE WE Data (in and out) CS WE SRAM 16x8 OE Data } Address { CS WE SRAM 16x8 OE Data } Address { CS WE SRAM 16x8 OE Data } Address { CS WE SRAM 16x8 OE Data } Address { Achtung: OE und WE sind active-low! Digitaltechnik Kapitel 6: Speicherelemente 24
25 The Spartan-3 Starter Kit board has a megabyte of fast asynchronous SRAM, surfacemounted to the backside of the board. The memory array includes two 256Kx16 ISSI IS61LV25616AL-10T 10 ns SRAM devices, as shown in Figure 2-1. A detailed schematic appears in Figure A-8. Das SRAM auf dem FPGA-Board ISSI 256Kx16 SRAM (10 ns) (see (see Table Table 2-3) 2-3) I/O[15:0] Spartan-3 FPGA CE1 UB1 LB1 (see (see Table 2-4) (see (see Table 2-1) (P7) (T4) (P6) A[17:0] CE UB LB WE OE ISSI 256Kx16 SRAM (10 ns) I/O[15:0] A[17:0] IC10 CE2 UB2 LB2 WE OE (N5) (R4) (P5) (G3) (K4) CE UB LB WE OE IC11 (xx) = FPGA pin number UG130_c2_01_ Digitaltechnik Kapitel 6: Speicherelemente Figure 2-1: FPGA to SRAM Connections 25
26 Das SRAM auf dem FPGA-Board CYCLE NO. 2 (1,3) trc ADDRESS taa toha OE tdoe thzoe CE tlzoe tlzce tace thzce LB, UB DOUT tlzb HIGH-Z tba trc DATA VALID thzb VDD Supply Current tpu Lesezyklus des IS61LV25616AL von ISSI 50% tpd ICC 50% ISB UB_CEDR2.eps HIGH for a Read Cycle. evice is continuously selected. OE, CE, UB, or LB = VIL. Digitaltechnik ss is valid prior Kapitel to or 6: coincident Speicherelemente with CE LOW transition. 26
27 Row- und Column-Address-Strobes Idee: Leitungen sparen durch stückweise Übertragung der Adresse Beispiel: Zeile und Spalte werden getrennt übertragen RAS: Row Address Strobe, CAS: Column Address Strobe Digitaltechnik Kapitel 6: Speicherelemente 27
28 RAS/CAS Schreibzyklus Address RAS Row Col CAS W E Data valid Digitaltechnik Kapitel 6: Speicherelemente 28
29 RAS/CAS Lesezyklus Address RAS Row Col CAS W E Data valid Digitaltechnik Kapitel 6: Speicherelemente 29
30 RAM-Modell mit RAS/CAS in Verilog module DRAM8MBIT(input [9:0] address, inout [7:0] data, input RAS, CAS, WE, OE); reg [9:0] row addr; 5 reg [19:0] mem addr; reg [7:0] mem [0:(1<<19) 1]; RAS) 10 row addr <= address; CAS) begin mem addr = (row addr<<10) + address; if (WE==0) 15 mem[mem addr] <= data; end assign data =!OE? mem[mem addr] : bzzzzzzzz; 20 endmodule Digitaltechnik Kapitel 6: Speicherelemente 30
31 Caches Erinnerung: DRAM langsam/billig, SRAM schnell/teuer Idee: SRAM als schnellen Zwischenspeicher (Cache) für DRAM verwenden Versteckt die Latenz des langsamen DRAMs Oft gute Trefferraten: > 90 % Digitaltechnik Kapitel 6: Speicherelemente 31
32 Caches CPU Cache (SRAM) Speicher (DRAM) Digitaltechnik Kapitel 6: Speicherelemente 32
33 Bus-Bursts RAM wird oft sequentiell gelesen Caches sind daher in Zeilen organisiert: aufeinanderfolgende Adressen (z.b. 256 Bytes) Bus-Bursts: effiziente Übertragung einer ganzen Zeile (ggf. mit Interleaving) Digitaltechnik Kapitel 6: Speicherelemente 33
34 Bus-Bursts Adresse RAS CAS OE Row Col DATA CLK D0 D1 D2 D3 CAS Latency (CL) Digitaltechnik Kapitel 6: Speicherelemente 34
35 Double Data Rate (DDR) RAM Adresse RAS CAS OE Row Col DATA CLK D0 D1 D2 D3 CAS Latency (CL) Digitaltechnik Kapitel 6: Speicherelemente 35
36 2GB 800MHz DDR2 Non-ECC Low-Latency CL4 ( ) DIMM (Kit of 2) KHX6400D2LLK2/2G Get Price 2GB 800MHz DDR2 Non-ECC Low-Lat CL4 ( ) DIMM (NVIDIA SLI-Ready) KHX6400D2LLK2/2GN Get Price Timings 2GB 1066MHz DDR2 Non-ECC CL5 ( ) DIMM KHX8500D2/2G Get Price 2GB 1066MHz DDR2 Non-ECC CL5 ( ) DIMM (Kit of 2) KHX8500D2K2/2G Get Price 2GB 1066MHz DDR2 CL5 ( ) DIMM (Kit of 2) (NVIDIA SLI-Ready) KHX8500D2K2/2GN Get Price 2GB 1150MHz DDR2 Non-ECC CL5 ( ) DIMM (Kit of 2) KHX9200D2K2/2G Get Price 2GB 1200MHz DDR2 Non-ECC CL5 ( ) DIMM (Kit of 2) KHX9600D2K2/2G Get Price 2GB 800MHz DDR2 ECC Low-Latency CL4 ( ) FBDIMM (Kit of 2) KHX6400F2LLK2/2G Get Price 4GB 800MHz DDR2 Non-ECC CL5 ( ) DIMM (Kit of 2) KHX6400D2K2/4G Get Price 4GB 800MHz DDR2 Non-ECC Low-Latency CL4 ( ) DIMM (Kit of 2) KHX6400D2LLK2/4G Get Price 4GB 1066MHz DDR2 Non-ECC CL5 ( ) DIMM (Kit of 2) KHX8500D2K2/4G Get Price 4GB 1066MHz DDR2 Non-ECC CL5 ( ) DIMM (Kit of 2) Tall HS KHX8500D2T1K2/4G Get Price 4GB 1066MHz DDR2 Non-ECC CL5 ( ) DIMM (Kit of 4) KHX8500D2K4/4G Get Price 8GB 800MHz DDR2 Non-ECC Low-Latency CL4 ( ) DIMM (Kit of 4) KHX6400D2LLK4/8G Get Price HyperX DDR3 1375MHz, 1600MHZ, 1625MHz, 1800MHz, 1866MHz and 2000MHz Description Part Number Price 1GB 1375MHz DDR3 Non-ECC Low-Latency CL7 ( ) DIMM KHX11000D3LL/1G Get Price 1GB 1600MHz DDR3 Non-ECC CL9 ( ) DIMM KHX12800D3/1G Get Price 1GB 1625MHz DDR3 Non-ECC Low-Latency CL7 ( ) DIMM KHX13000D3LL/1G Get Price 1GB 1625MHz DDR3 Non-ECC Low-Latency CL7 ( ) DIMM KHX13000AD3LL/1G Get Price 1GB 1800MHz DDR3 Non-ECC CL8 ( ) DIMM KHX14400D3/1G Get Price 1GB 1800MHz DDR3 Non-ECC CL8 ( ) DIMM KHX14400AD3/1G Get Price 2GB 1375MHz DDR3 Non-ECC CL9 (9-9-9) DIMM (Kit of 2) KHX11000D3K2/2G Get Price 2GB 1375MHz DDR3 Non-ECC Low-Latency CL7 ( ) DIMM KHX11000D3LL/2G Get Price 2GB 1375MHz DDR3 Non-ECC CL7 ( ) DIMM (Kit of 2) KHX11000D3LLK2/2G Get Price 2GB 1375MHz DDR3 Non-ECC CL7 ( ) DIMM (Kit of 2) Intel XMP KHX11000D3LLK2/2GX Get Price 2GB 1600MHz DDR3 Non-ECC CL9 ( ) DIMM KHX12800D3/2G Get Price 2GB 1600MHz DDR3 Non-ECC CL9 ( ) DIMM (Kit of 2) KHX12800D3K2/2G Get Price 2GB 1625MHz DDR3 Non-ECC Low-Latency CL7 ( ) DIMM KHX13000D3LL/2G Get Price 2GB 1625MHz DDR3 Non-ECC Low-Latency CL7 ( ) DIMM (Kit of 2) KHX13000D3LLK2/2G Get Price 2GB 1625MHz DDR3 Low Latency CL8 ( ) DIMM (Kit of 2) NVIDIA SLI KHX13000D3LLK2/2GN Get Price Digitaltechnik Kapitel 6: Speicherelemente 36
37 Timings Beispiel: Aktueller Standard: 1. CAS Latency 2. RAS-to-CAS Delay 3. RAS Precharge 4. Act-to-Precharge Delay Digitaltechnik Kapitel 6: Speicherelemente 37
6 Speicherelemente. Digitaltechnik. Übersicht. Adressen. Read-Only Memory ROM. Random Access Memory RAM. Datenbusse. Caches.
A Digitaltechnik 6 Speicherelemente Übersicht n Read-Only Memory ROM Random Access Memory RAM Datenbusse Revision 1.4 Caches Speicher Memory RAM in PCs ROM: read-only memory RAM: random-access memory (besser
MehrTutorium Rechnerorganisation
Woche 9 Tutorien 3 und 4 zur Vorlesung Rechnerorganisation 1 Christian A. Mandery: KIT Universität des Landes Baden-Württemberg und nationales Grossforschungszentrum in der Helmholtz-Gemeinschaft www.kit.edu
MehrSpeicher (1) zur Realisierung eines Rechnerspeichers benötigt man eine Materie mit physikalischen Eigenschaften, die
Speicher (1) Definition: Speichern ist die kurz- oder langfristige Änderung einer oder mehrerer physikalischer Eigenschaften einer Materie durch ein externes Ereignis. zur Realisierung eines Rechnerspeichers
Mehr13 Programmierbare Speicher- und Logikbausteine
13 Programmierbare Speicher- und Logikbausteine Speicherung einer Tabelle (Programm) Read Only Memory (ROM) Festwertspeicher Nichtflüchtig Nichtlöschbar: ROM PROM bzw. OTP-ROM Anwender programmierbares
MehrRechnerstrukturen. 5. Speicher. Inhalt. Vorlesung Rechnerstrukturen Wintersemester 2002/03. (c) Peter Sturm, Universität Trier 1.
Rechnerstrukturen 5. Speicher 5.1 Motivation Speichertypen RAM / ROM Dynamisches RAM Inhalt Cache-Speicher Voll Assoziativ n-wege Assoziativ Direct Mapping 5.2 (c) Peter Sturm, Universität Trier 1 Der
MehrRechnerstrukturen Winter SPEICHER UND CACHE. (c) Peter Sturm, University of Trier 1
9. SPEICHER UND CACHE (c) Peter Sturm, University of Trier 1 Inhalt Grundlagen Speichertypen RAM / ROM Dynamisches RAM Cache- Speicher Voll AssoziaNv n- Wege AssoziaNv Direct Mapping Beispiel: 8 Bit- Register
MehrRO-Tutorien 3 / 6 / 12
RO-Tutorien 3 / 6 / 12 Tutorien zur Vorlesung Rechnerorganisation Christian A. Mandery WOCHE 10 AM 01./02.07.2013 KIT Universität des Landes Baden-Württemberg und nationales Forschungszentrum in der Helmholtz-Gemeinschaft
MehrDigital Design Entwicklung der DRAMs. Richard Roth / FB Informatik und Mathematik Speicher 1
Entwicklung der DRAMs Richard Roth / FB Informatik und Mathematik Speicher 1 Entwicklung der DRAMs in Zukunft Richard Roth / FB Informatik und Mathematik Speicher 2 DRAM Speicherzelle (Trench Technology)
MehrDIE EVOLUTION DES DRAM
DIE EVOLUTION DES DRAM Gliederung 1. Motivation 2. Aufbau und Funktionsweise 3. SDRAM 4. DDR SDRAM 5. DDR SDRAM Versionen 06.02.2018 Die Evolution des DRAM Folie 2 von 27 1. Motivation Motivation - Immer
MehrBesprechung des 7. Übungsblattes Speicheraufbau Speichertypen DRAM Speicherbelegung
Themen heute Besprechung des 7. Übungsblattes Speicheraufbau Speichertypen DRAM Speicherbelegung Besprechung des 7. Übungsblattes Aufgabe 4a Der eigentliche Sprung erfolgt in der MEM-Phase (4. Pipeline-Stufe),
MehrErweiterung von Adressraum und Bit Tiefe
Erweiterung von Adressraum und Bit Tiefe Erweiterung des vorigen Beispiels ist offensichtlich: Vergrößerung des Adressraums (in der Größenordnung 2 n ): Füge eine Adressleitung hinzu und verdoppele die
MehrRechnerorganisation. 1. Juni 201 KC Posch
.6.2 Rechnerorganisation. Juni 2 KC Posch .6.2 2 .6.2 Front Side Bus Accelerated Graphics Port 28 MHz Front Side Bus North Bridge RAM idge South Bri IDE USB PCI Bus 3 .6.2 Front Side Bus Front Side Bus
MehrSpeicher: RAMs, ROMs PROMS, EPROMs, EEPROMs, Flash EPROM
Speicher: RAMs, ROMs PROMS, EPROMs, EEPROMs, Flash EPROM RAMs (Random Access Memory) - Schreib-Lese-Speicher RAMs sind Speicher mit der Aufgabe, binäre Daten für eine bestimmte Zeit zu speichern. Diese
MehrErgänzung: RAM und ROM. SS 2012 Grundlagen der Rechnerarchitektur Speicher 72
Ergänzung: RAM und ROM SS 2012 Grundlagen der Rechnerarchitektur Speicher 72 Speichern eines Bits versus viele MB Wir wissen wie wir einzelne Bits speichern können (Erinnerung: Latches, Flip Flops) Mehrere
MehrB Hauptspeicher und Cache
und Cache 1. Begriffe 2. SRAM 3. DRAM 4. DRAM-Varianten: EDO-RAM, SDRAM, DDR-RAM, RAMBUS 5. Festwertspeicher: PROM, EPROM, EEPROM 6. Exkurs: Assoziativspeicher 7. Cache 1 und Cache Einordnung in das Schichtenmodell:
MehrB Hauptspeicher und Cache
und Cache und Cache Einordnung in das Schichtenmodell: 1. Begriffe 2. SRAM 3. DRAM 4. DRAM-Varianten: EDO-RAM, SDRAM, DDR-RAM, RAMBUS 5. Festwertspeicher: PROM, EPROM, EEPROM 6. Exkurs: Assoziativspeicher
MehrE Hauptspeicher und Cache
und Cache 1. Begriffe 2. SRAM 3. DRAM 4. DRAM-Varianten: EDO-RAM, SDRAM, DDR-RAM, RAMBUS 5. Festwertspeicher: PROM, EPROM, EEPROM 6. Exkurs: Assoziativspeicher 7. Cache 1 und Cache Einordnung in das Schichtenmodell:
MehrE Hauptspeicher und Cache
und Cache und Cache Einordnung in das Schichtenmodell: 1. Begriffe 2. SRAM 3. DRAM 4. DRAM-Varianten: EDO-RAM, SDRAM, DDR-RAM, RAMBUS 5. Festwertspeicher: PROM, EPROM, EEPROM 6. Exkurs: Assoziativspeicher
MehrHalbleiterspeicher. Halbleiterspeicher. 30.09.2008 Michael Kuhfahl 1
Halbleiterspeicher 30.09.2008 Michael Kuhfahl 1 Gliederung I. FF als Speicher (1 Bit) II. Register als Speicher (n Bit) III. Anordnung der Speicherzellen IV. SRAM V. DRAM VI. ROM VII. PROM VIII. EPROM
MehrNicht flüchtige Speicher: Nicht löschbar: ROM, PROM (z.b. System). löschbar: EPROM, EEPROM, Flash (z.b. BIOS).
3. Speicher 3.1. Überblick Entwicklung: Speicherchips Chip-Kapazität: 256 kbit (ca. 1988) 4 GBit (2001, nicht in Serie). Zugriffszeiten: 250ns (1980), 145 ns (1992), 70ns (1994), 7ns (heute). Ursprüngliche
MehrSoftware ubiquitärer Systeme
Software ubiquitärer Systeme Übung 2: Speicherarchitekturen in Mikrocontrollern und AOStuBS Christoph Borchert Arbeitsgruppe Eingebettete Systemsoftware Lehrstuhl für Informatik 12 TU Dortmund http://ess.cs.uni-dortmund.de/~chb/
MehrModul 304: Personalcomputer in Betrieb nehmen Thema: Speicher. Speicher / Memory V 1.0. Technische Berufsschule Zürich IT Seite 1
Speicher / Memory V 1.0 Technische Berufsschule Zürich IT Seite 1 Einleitung: Der Speicher (engl. Memory) ist eine Kernfunktion in einem Rechner. Programme und Daten werden in Speichern abgelegt. Man spricht
MehrKlassifizierung der Halbleiterspeicher
Klassifizierung der Halbleiterspeicher Halbleiterspeicher nicht flüchtig flüchtig AM nicht löschbar OM POM löschbar EPOM EEPOM statisch AM dynamisch AM abei bedeuten die Abürzungen: OM AM POM EPOM EEPOM
Mehra. Flipflop (taktflankengesteuert) Wdh. Signalverläufe beim D-FF
ITS Teil 2: Rechnerarchitektur 1. Grundschaltungen der Digitaltechnik a. Flipflop (taktflankengesteuert) Wdh. Signalverläufe beim D-FF b. Zähler (Bsp. 4-Bit Zähler) - Eingang count wird zum Aktivieren
MehrSerielle Kommunikation mit dem Arduino. Teil 1: Das Serial Peripheral Interface (SPI)
Serielle Kommunikation mit dem Arduino Teil 1: Das Serial Peripheral Interface (SPI) Axel Attraktor e.v. 4. Juni 2012 Axel (Attraktor e.v.) 5. Arduino-Stammtisch 4. Juni 2012 1 / 25 Serielle Kommunikation
MehrRam/Rom/EPRom WIRTSCHAFTSINGENIEURSWESEN. Ausbildungsschwerpunkte: BETRIEBSMANAGEMENT LOGISTIK. Xaver Schweitzer. Jahr: 2011/12
Name: Klasse: Xaver Schweitzer 1BHWI Jahr: 2011/12 Ram/Rom/EPRom Abb. 1 Abb. 2 Abb. 3 Ram Rom EPRom 22.09.2011 1 von 10 Inhaltsverzeichnis INHALTSVERZEICHNIS... 2 EINLEITUNG... 3 RAM... 4 SRAM - Static
MehrEinführung in Computer Microsystems 8. Speicher, PLLs, Busse
Einführung in Computer Microsystems 8. Speicher, PLLs, Busse Prof. Dr.-Ing. Sorin A. Huss Fachbereich Informatik Integrierte Schaltungen und Systeme SS 2009 Integrierte Schaltungen und Systeme Einführung
MehrComputer: PC. Informationstechnik für Luft-und Raumfahrt Aerospace Information Technology
Computer: PC Informationstechnik für Luft-und Raumfahrt Ab Morgen nur eingebete Systeme Aber es gibt auch PCs Na gut... dann Heute. dann haben wir es hinter uns Und nicht wenige! PCs in N Jahren Industrie
MehrTeil 1: Digitale Logik
Teil 1: Digitale Logik Inhalt: Boolesche Algebra kombinatorische Logik sequentielle Logik kurzer Exkurs technologische Grundlagen programmierbare logische Bausteine 1 Tri-State Ausgangslogik Ausgang eines
MehrElektrizitätslehre und Elektronik. Halbleiterspeicher
1/5 Halbleiterspeicher Ein Halbleiterspeicher ist ein Datenspeicher, der aus einem Halbleiter besteht, in dem mittels der Halbleitertechnologie integrierte Schaltkreise realisiert werden. Die Daten werden
MehrMicrocontroller Kurs. 08.07.11 Microcontroller Kurs/Johannes Fuchs 1
Microcontroller Kurs 08.07.11 Microcontroller Kurs/Johannes Fuchs 1 Was ist ein Microcontroller Wikipedia: A microcontroller (sometimes abbreviated µc, uc or MCU) is a small computer on a single integrated
MehrTechnische Grundlagen der Informatik Kapitel 5. Prof. Dr. Sorin A. Huss Fachbereich Informatik TU Darmstadt
Technische Grundlagen der Informatik Kapitel 5 Prof. Dr. Sorin A. Huss Fachbereich Informatik TU Darmstadt Kapitel 5: Themen Speicherarchitekturen RAM-, ROM-Speicher Flash-Speicher Logikimplementierung
MehrRAM - Random Access Memory
RAM - Random Access Memory Random Access Memory (dt. Speicher mit wahlfreiem Zugriff), abgekürzt RAM, ist ein Speicher, der besonders bei Computern als Arbeitsspeicher Verwendung findet. RAMs werden als
MehrDigitaltechnik II SS 2007
Digitaltechnik II SS 27 6. Vorlesung Klaus Kasper Inhalt Asynchroner Zähler Synchroner Zähler Schaltungsanalyse Register Halbleiterspeicher Random Access Memory (RAM) SRAM DRAM Digitaltechnik 2 2 Frequenzteiler
MehrSRAM-Zelle Lesevorgang
SRAM-Zelle Lesevorgang 1 im Flipflop gespeichert U DD Bit Bit Wort - Low - Potential - High - Potential 195 SRAM-Zelle Schreibvorgang 1 im Flipflop gespeichert U DD Bit Bit Wort - Low - Potential - High
MehrProgrammierbare Logik CPLDs. Studienprojekt B Tammo van Lessen
Programmierbare Logik CPLDs Studienprojekt B Tammo van Lessen Gliederung Programmierbare Logik Verschiedene Typen Speichertechnologie Komplexe Programmierbare Logik System On a Chip Motivation Warum Programmierbare
MehrHauptspeicher H.1.1 Einordnung Organisation und Verhalten von Hauptspeichermodulen. Caches und assoziative Speicherung. Höhere Informatik :
H. Hauptspeicher H.. Einordnung Organisation und Verhalten von Hauptspeichermodulen. Caches und assoziative Speicherung. Höhere Informatik : Hierarchische Datenspeicherung. - Programmierung, Datenbanken,
Mehr19. Speicher Überblick Entwicklung: Speicherchips
19. Speicher 19.1. Überblick Entwicklung: Speicherchips Chip-Kapazität: 256 kbit (ca. 1988) 4 GBit (2001, nicht in Serie). Zugriffszeiten: 250ns (1980), 145 ns (1992), 70ns (1994), 7ns (heute). Ursprüngliche
Mehr5 Zusammengesetzte und reguläre Schaltungsstrukturen
5 Zusammengesetzte und reguläre Schaltungsstrukturen regelmäßig aufgebaute (reguläre) Schaltungsstrukturen implementieren jeweils eine größere Zahl an Gatterfunktionen wichtigste Vertreter: Speicher, programmierbare
MehrDigitaltechnik II SS 2007
Digitaltechnik II SS 27 7. Vorlesung Klaus Kasper Inhalt Register Halbleiterspeicher Random Access Memory (RAM) SRAM DRAM ROM Programmierbare ROM Realisierung digitaler Systeme Digitaltechnik 2 2 Digitaltechnik
Mehreinfache DRAMs sind heute nicht mehr erhältlich, sondern nur noch die schnelleren DRAM-Varianten...
3 DRAM (10) Vor-/Nachteile von DRAM-Bausteinen: periodischer Refresh erforderlich hohe Zugriffszeit von ca. 60 ns für das erste Datenwort, dank FPM kürzere Zugriffszeit von ca. 30 ns für folgende Datenworte
MehrVorlesung: Technische Informatik 3
Rechnerarchitektur und Betriebssysteme zhang@informatik.uni-hamburg.de Universität Hamburg AB Technische Aspekte Multimodaler Systeme zhang@informatik.uni-hamburg.de Inhaltsverzeichnis 4. Computerarchitektur........................235
MehrKurzanleitung um Transponder mit einem scemtec TT Reader und der Software UniDemo zu lesen
Kurzanleitung um Transponder mit einem scemtec TT Reader und der Software UniDemo zu lesen QuickStart Guide to read a transponder with a scemtec TT reader and software UniDemo Voraussetzung: - PC mit der
MehrCPU Speicher I/O. Abbildung 11.1: Kommunikation über Busse
Kapitel 11 Rechnerarchitektur 11.1 Der von-neumann-rechner Wir haben uns bisher mehr auf die logischen Bausteine konzentriert. Wir geben jetzt ein Rechnermodell an, das der physikalischen Wirklichkeit
MehrReferat von Sonja Trotter. Hauptspeicher / Arbeitsspeicher / Speicher / RAM
Referat von Sonja Trotter Hauptspeicher / Arbeitsspeicher / Speicher / RAM Inhaltsverzeichnis 1. Einleitung 2. Speicher 3. Hauptspeicher 3.1. Arbeitsspeicher 3.1.1. Allgemein 3.1.2. Leistungsmerkmale des
Mehr2. Halbleiterspeicher
2. Halbleiterspeicher Speicher mit wahlfreiem Zugriff (Random Access Memory): Zu jeder Speicherstelle kann gleich schnell zugegriffen werden. Matrixförmige Anordnung von 1Bit Speicherzellen, jede Speicherzelle
Mehr2.2 Rechnerorganisation: Aufbau und Funktionsweise
2.2 Rechnerorganisation: Aufbau und Funktionsweise é Hardware, Software und Firmware é grober Aufbau eines von-neumann-rechners é Arbeitsspeicher, Speicherzelle, Bit, Byte é Prozessor é grobe Arbeitsweise
MehrGrundlagen der Informatik 2. Grundlagen der Digitaltechnik. 5. Digitale Speicherbausteine
Grundlagen der Informatik 2 Grundlagen der Digitaltechnik 5. Digitale Speicherbausteine Prof. Dr.-Ing. Jürgen Teich Dr.-Ing. Christian Haubelt Lehrstuhl für Hardware-Software Software-Co-Design Grundlagen
MehrHardware-Pyramide. Teil D3: Vom Transistor zum Ein-Chip-System. Transistor. Größe der Transistoren. 06 / Teil D3 / Seite 01
eil 3: Vom ransistor zum Ein-Chip-ystem ransistoren in der igitaltechnik Gatter Flip-Flops RM Ein-Chip-ystem Hardware-Pyramide EV ystem Zentraleinheit, Peripherie komplee Funktionsbaugr. peicherzellen,
MehrBitRecords FPGA Modul XC6SLX25_V2.0, Mai2013 1
BitRecords FPGA Modul XCSLX FPGA Modul zur Anwendung im Hobby- und Prototypenbereich Eigenschaften: Xilinx Spartan (XCSLX-FGGC) Nutzer-IOs On-Board 0MHz Oszillator LEDs, Taster Rastermaß:. mm Maße: x mm
MehrSSDs und Flash Memory. Matthias Müller 16.Juni 2010 Institut für Verteilte Systeme
SSDs und Flash Memory Matthias Müller 16.Juni 2010 Institut für Verteilte Systeme Seite 2 Inhalt Motivation Aufbau und Funktionsweise NAND vs NOR SLC vs MLC Speicherorganisation Vergleich mit konventionellen
MehrMikrocontroller Grundlagen. Markus Koch April 2011
Mikrocontroller Grundlagen Markus Koch April 2011 Übersicht Was ist ein Mikrocontroller Aufbau (CPU/RAM/ROM/Takt/Peripherie) Unterschied zum Mikroprozessor Unterschiede der Controllerarten Unterschiede
MehrQuick XMP Ü bertaktungseinstellungen
Quick XMP Ü bertaktungseinstellungen Intel XMP (Extreme Memory Profile) ermöglicht Anwendern das einfache Ü bertakten von XPG Speicher durch die Änderung von Einstellungen im BIOS und somit das Erreichen
MehrLerndokumentation. Arbeitsspeicher. Lerndokumentation Arbeitsspeicher. Ausbildung Vorlehre Informatik. Autor: Ramon Schenk
. Kingston DIMM Riegel, High-End RAM mit Passiv-Kühlung Autor: Ramon Schenk Inhaltsverzeichnis 1 Übersicht Dokumentation... 2 2 Der... 2 2.1 Erläuterung... 2 2.2 Speicherverfahren... 2 2.3 Bedeutung des
MehrFeldeffekttransistoren in Speicherbauelementen
Feldeffekttrasistore i Speicherbauelemete DRAM Auch we die Versorgugsspaug aliegt, ist ei regelmäßiges (typischerweise eiige ms) Refresh des Speicherihaltes erforderlich (Kodesator verliert mit der Zeit
MehrAdressierung von Speichern und Eingabe- Ausgabegeräten
Adressierung von Speichern und Eingabe- Ausgabegeräten Adressdecodierung Die Busstruktur von Prozessorsystemen verbindet die Bauteile über gemeinsame Leitungen. Auf dem Bus darf zu einer Zeit immer nur
MehrCU-R-CONTROL. Beschreibung zur Schaltung ATMega16-32+ISP MC-Controller Steuerung auf Basis ATMEL Mega16/32. Autor: Christian Ulrich
Seite 1 von 10 CU-R-CONTROL Beschreibung zur Schaltung ATMega16-32+ISP MC-Controller Steuerung auf Basis ATMEL Mega16/32 Autor: Christian Ulrich Datum: 08.12.2007 Version: 1.00 Seite 2 von 10 Inhalt Historie
Mehr2. Ansatzpunkt: Reduktion der Penalty Early Restart und critical word first
2. Ansatzpunkt: Reduktion der Penalty 2.1. Early Restart und critical word first Beide Techniken basieren darauf, die Wartezeit der CPU auf das Mindestmaß zu beschränken. Early restart lädt den Block wie
MehrInterrupt-Programmierung
Interrupt-Programmierung Am Beispiel des ATMEGA16 Microcontrollers Beispiel: Messung der Betriebszeit Die Betriebszeit zeigt an, wie lange der Rechner seit dem Booten läuft Hier: Aktualisierung der Betriebszeit
MehrIT für Führungskräfte. Zentraleinheiten. 11.04.2002 Gruppe 2 - CPU 1
IT für Führungskräfte Zentraleinheiten 11.04.2002 Gruppe 2 - CPU 1 CPU DAS TEAM CPU heißt Central Processing Unit! Björn Heppner (Folien 1-4, 15-20, Rollenspielpräsentation 1-4) Harald Grabner (Folien
MehrDer Prozessor, der mitdenkt! Alles zu intelligenter Leistung und den Intel Core i5 vpro Prozessoren mit Turbo-Boost-Technik.
Page 1 of 7 Empfehlungen von plista Schlossgarten mit Gewalt mehr US-Astronomen finden «bewohnbaren» Planeten mehr Teure Kredite ablösen & Zinsen sparen Dispo und andere Kredite mit dem günstigen C&A Ratenkredit
MehrDF PROFI II PC/104-Plus
DF PROFI II PC/104-Plus Installationsanleitung V1.3 04.08.2009 Project No.: 5302 Doc-ID.: DF PROFI II PC/104-Plus COMSOFT d:\windoc\icp\doku\hw\dfprofi ii\installation\pc104+\version_1.3\df profi ii pc
MehrKlausur zur Mikroprozessortechnik
Prof. Dr. K. Wüst WS 2001 FH Gießen Friedberg, FB MNI Studiengang Informatik Klausur zur Mikroprozessortechnik Nachname: Vorname: Matrikelnummer: 7.3.2001 Punkteverteilung Aufgabe Punkte erreicht 1 3 2
MehrSpeicher Typen. TI-Übung 5. Speicher SRAM. Speicher DRAM. SRAM vs. DRAM (EEP)ROM, NV-RAM, Flash,... Speicher, Caches
Speicher Typen TI-Übung 5 Speicher, Caches Andreas I. Schmied (andreas.schmied@uni-ulm.de) AspectIX-Team Abteilung Verteilte Systeme Universität Ulm WS2005 SRAM vs. DRAM (EEP)ROM, NV-RAM, Flash,... Charakteristik
MehrHochschule München, FK 03 FA SS 2012. Ingenieurinformatik
Hochschule München, FK 03 FA SS 2012 Ingenieurinformatik Zulassung geprüft vom Aufgabensteller: Teil 1/Aufgabe 1: 30 Minuten ohne Unterlagen, Teil 2/Aufgaben 2-4: 60 Minuten, beliebige eigene Unterlagen
MehrHalbleiterphysik und Anwendungen Vorlesungsplanung Teil 10: Speicherbauelemente Prof. Dr. Sven Ingebrandt
Halbleiterphysik und Anwendungen Teil 10: Speicherbauelemente Prof. Dr. Sven Ingebrandt Fachhochschule Kaiserslautern - Standort Zweibrücken www.hs-kl.de Vorlesungsplanung Grün: Termine, die ausfallen
MehrUniversität Bielefeld Technische Fakultät AG Rechnernetze und verteilte Systeme. Vorlesung 4: Memory. Wintersemester 2001/2002. Peter B.
Universität Bielefeld Technische Fakultät AG Rechnernetze und verteilte Systeme Vorlesung 4: Memory Peter B. Ladkin Address Translation Die Adressen, die das CPU benutzt, sind nicht identisch mit den Adressen,
MehrRO-Serie CAN-Übertragungsprotokoll
RO-Serie CAN-Übertragungsprotokoll Juni 2009 1 EINLEITUNG...3 2 REGISTER-ZUGRIFFE...4 2.1 Was sind überhaupt Register?... 4 2.2 Registerzugriff mit 8/ 16 oder 32 Bit-Datenbreite... 4 2.3 Registerbelegung...
MehrDIGITALVARIO. Anleitung Bootloader. Ausgabe 0.1 deutsch 29.11.2005. für Direkt-Digital-Vario. Firmware ab 00-06-00 Hardware 01 Seriennummer ab 0003
DIGITALVARIO Anleitung Bootloader Ausgabe 0.1 deutsch 29.11.2005 für Direkt-Digital-Vario Firmware ab 00-06-00 Hardware 01 Seriennummer ab 0003 1. Funktion Der Bootloader dient dazu Updates der Variosoftware
MehrWozu dient ein Logikanalysator?
Wozu dient ein Logikanalysator? Beispiel: Microcontroller Microcontroller kommen vor in Haushaltsgeräten (Waschmaschine,...) in Fahrzeugen (ABS, Motorsteuerung, Radio,...) in Computern (Tastatur, Festplatte,
Mehr1. Übung aus Digitaltechnik 2. 1. Aufgabe. Die folgende CMOS-Anordnung weist einen Fehler auf:
Fachhochschule Regensburg Fachbereich Elektrotechnik 1. Übung aus Digitaltechnik 2 1. Aufgabe Die folgende CMOS-Anordnung weist einen Fehler auf: A B C p p p Y VDD a) Worin besteht der Fehler? b) Bei welcher
Mehr1CONFIGURATION MANAGEMENT
1CONFIGURATION MANAGEMENT Copyright 11. April 2005 Funkwerk Enterprise Communications GmbH Bintec Benutzerhandbuch - X2250 Version 1.0 Ziel und Zweck Haftung Marken Copyright Richtlinien und Normen Wie
MehrArithmetische und Logische Einheit (ALU)
Arithmetische und Logische Einheit (ALU) Enthält Blöcke für logische und arithmetische Operationen. n Bit Worte werden mit n hintereinander geschalteten 1 Bit ALUs bearbeitet. Steuerleitungen bestimmen
MehrAutomatisierung ( Fernsteuerung ) von Excel unter Microsoft Windows Tilman Küpper (tilman.kuepper@hm.edu)
HMExcel Automatisierung ( Fernsteuerung ) von Excel unter Microsoft Windows Tilman Küpper (tilman.kuepper@hm.edu) Inhalt 1. Einleitung...1 2. Beispiele...2 2.1. Daten in ein Tabellenblatt schreiben...2
MehrSMP Übung 2 1. Aufgabe
SMP Übung 2 1. Aufgabe a) Kilo: K = 2 10 = 1.024 Mega: M = 2 20 = 1.048.576 Giga: G = 2 30 = 1.073.741.824 Tera: T = 2 40 = 1.099.511.627.776 b) Der Prozessor hat 30 Adressleitungen A[31..2], mit denen
Mehr1. Stellenwerte im Dualsystem
1. a) Definitionen Stellenwertsystem Ein Zahlensystem bei dem der Wert einer Ziffer innerhalb einer Ziffernfolge von ihrer Stelle abhängt, wird Stellenwertsystem genannt. Die Stellenwerte sind also ganzzahlige
MehrTietze, Schenk: Halbleiterschaltungstechnik (Kap. 10) Keller / Paul: Hardwaredesign (Kap. 5) L. Borucki: Digitaltechnik (Kap.
6 Versuch Nr. 5 6.1 Anmerkungen zum Versuch Nr. 5 In den bisherigen Versuchen haben Sie sich mit kombinatorischen Schaltkreisen beschäftigt, in denen die Ausgänge bisher nicht auf die Eingänge zurückgeführt
MehrVorlesung. Technologische Grundlagen der Informationsverarbeitung. Speicherung von Daten. Dipl.-Ing. Gert Martin
Vorlesung Technologische Grundlagen der Informationsverarbeitung Speicherung von Daten Dipl.-Ing. Gert Martin Datenspeicherung Prinzipien: Magnetische Speicherung Halbleiterspeicher (Speicher mit elektronischen
MehrEinführung in die Welt der Microcontroller
Übersicht Microcontroller Schaltungen Sonstiges Einführung in die Welt der Microcontroller Übersicht Microcontroller Schaltungen Sonstiges Inhaltsverzeichnis 1 Übersicht Möglichkeiten Einsatz 2 Microcontroller
MehrGamer-PC-zusammenstellen.com Einen Gamer PC zusammenstellen. Checkliste und Anleitungen
Gamer-PC-zusammenstellen.com Einen Gamer PC zusammenstellen Checkliste und Anleitungen 1. Zur Handhabung des Dokuments Dieses Dokument soll Dir dabei helfen, selbstständig einen Gamer PC zusammenzustellen.
MehrCisco AnyConnect VPN Client - Anleitung für Windows7
Cisco AnyConnect VPN Client - Anleitung für Windows7 1 Allgemeine Beschreibung 2 2 Voraussetzungen für VPN Verbindungen mit Cisco AnyConnect Software 2 2.1 Allgemeine Voraussetzungen... 2 2.2 Voraussetzungen
MehrFachbereich Medienproduktion
Fachbereich Medienproduktion Herzlich willkommen zur Vorlesung im Studienfach: Grundlagen der Informatik Themenübersicht Rechnertechnik und IT Sicherheit Grundlagen der Rechnertechnik Prozessorarchitekturen
Mehr5. Schaltwerke und Speicherelemente S Q
5. chaltwerke und peicherelemente T chaltwerke Takt, peicherelemente, Flip-Flops Verwendung von Flip-Flops peicherzellen, egister Kodierer, peicher 72 chaltwerke vs. chaltkreise chaltkreise bestehen aus
MehrRechnernetze und Organisation
Memory 1 Übersicht Motivation Speicherarten Register SRAM, DRAM Flash Speicherhierarchie Cache Virtueller Speicher 2 Motivation Speicher ist zentraler Bestandteil eines Computers neben Prozessor CPU Computer
MehrI Serverkalender in Thunderbird einrichten
I Serverkalender in Thunderbird einrichten Damit Sie den Kalender auf dem SC-IT-Server nutzen können, schreiben Sie bitte zuerst eine Mail mit Ihrer Absicht an das SC-IT (hilfe@servicecenter-khs.de). Dann
MehrVorlesung: Rechnerstrukturen, Teil 2 (Modul IP7)
Vorlesung: Rechnerstrukturen, Teil 2 (Modul IP7) Vorlesung: Rechnerstrukturen, Teil 2 (Modul IP7) J. Zhang zhang@informatik.uni-hamburg.de Universität Hamburg AB Technische Aspekte Multimodaler Systeme
Mehreasyident Türöffner easyident Türöffner Art. Nr. FS-0007 FS Fertigungsservice
easyident Türöffner Art. Nr. FS-0007 Wir freuen uns, das sie sich für unser Produkt easyident Türöffner, mit Transponder Technologie entschieden haben. Easyident Türöffner ist für Unterputzmontage in 55mm
MehrJohann Wolfgang Goethe-Universität
Flynn sche Klassifikation SISD (single instruction, single data stream): IS IS CU PU DS MM Mono (Mikro-)prozessoren CU: Control Unit SM: Shared Memory PU: Processor Unit IS: Instruction Stream MM: Memory
MehrATMega2560Controllerboard
RIBU ELEKTRONIK VERSAND Mühlenweg 6. 8160 Preding. Tel. 017/64800. Fax 64806 Mail: office1@ribu.at. Internet: http://www.ribu.at ATMega560Controllerboard nur 66 x 40 mm große 4 fach Multilayer Platine
MehrVon Bits, Bytes und Raid
Von Bits, Bytes und Raid Eine Schnuppervorlesung zum Kennenlernen eines Datenspeichers um Bits und Bytes zu unterscheiden um Raid-Festplattensysteme zu verstehen Inhalt Speicherzellen sind elektronische
MehrAnwenderprogrammierbare
4. Einteilung der Programmiertechnologien Programmable logic device (PLD) Field programmable gate array (FPGA) Zusammenfassende Bewertung S. A. Huss / Folie 4-1 Einteilung der Programmiertechnologien Programmierung
MehrEyeCheck Smart Cameras
EyeCheck Smart Cameras 2 3 EyeCheck 9xx & 1xxx Serie Technische Daten Speicher: DDR RAM 128 MB FLASH 128 MB Schnittstellen: Ethernet (LAN) RS422, RS232 (nicht EC900, EC910, EC1000, EC1010) EtherNet / IP
MehrHigh Performance Datenerfassung Tests am Beispiel WEGA
High Performance Datenerfassung am Beispiel WEGA Langmuir 5. Mai 2010 High Performance Datenerfassung am Beispiel WEGA Hardware Timing Netzwerk Hardware zwei identische Systeme bestehend aus Controller
MehrTechnische Grundlagen der Informatik
Technische Grundlagen der Informatik WS 2008/2009 13. Vorlesung Klaus Kasper WS 2008/2009 Technische Grundlagen der Informatik 1 Wiederholung Register Multiplexer Demultiplexer Halbleiterspeicher Statisches
MehrThermoguard. Thermoguard CIM Custom Integration Module Version 2.70
Thermoguard Thermoguard CIM Custom Integration Module Version 2.70 Inhalt - Einleitung... 3 - Voraussetzungen... 3 - Aktivierung und Funktion der Schnittstelle... 3 - Parameter... 4 - NLS-Einfluss... 4
MehrFlüchtige Halbleiterspeicher: statisch: SRAM (für Caches). dynamisch: DRAM (für Arbeitsspeicher).
3. Speicher 3.1. Überblick Entwicklung: Speicherchips Chip-Kapazität: 256 kbit (ca. 1988) 4 GBit (2001, nicht in Serie). Zugriffszeiten: 250ns (1980), 145 ns (1992), 70ns (1994), 7ns (heute). Ursprüngliche
Mehr